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[参考译文] DIX9211:BFRAME 信号延迟和放大器;帧同步

Guru**** 2470950 points
Other Parts Discussed in Thread: DIX9211, PCM9211, DIX4192

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/1551486/dix9211-bframe-signal-latency-frame-synchronization

部件号:DIX9211
主题中讨论的其他器件: PCM9211DIX4192

工具/软件:

您好、

我正在探索  DIX9211 是否适合 用于 Ultranet 的收发器

总之、Ultranet 电缆的一半是一根双绞线、该双绞线承载 8 个 48kHz 通道的音频、多路复用到 192kHz AES3 信号上。  
数据如下所示:

同步/多路信号分离可在 LRCK 和 BFRAME 的帮助下完成。

目前、我正在测试芯片的 DIR 部分;输出将进入 FPGA 来执行通道多路信号分离、但现在我只看一下我的逻辑分析仪。
芯片似乎工作正常;解码工作正常。

但是、我只注意到 B 帧前导码和 BFRAME 信号实际发出之间的可怕延迟(重新查看数据表后,这似乎是正常现象)。

这是逻辑分析仪的捕获结果。

是否有另一种向 B 帧发出信号的方式、这种方式会更加预热?

或者、如果芯片无法实现、是否有另一个芯片不会有这样的延迟?

谢谢、

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    您好 Samuel、

     我不知道有任何其他方法来发送 B 帧信号。  此外, PCM9211(DIX9211),我们有 DIX4192, 但我 不知道 这是否 会有更少的延迟 (PCM9211 是我们最流行和先进的设备)   

    此致、

    Arash

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    您好、

    那么、如果无法将块启动信号精确地置于正确的帧上、则似乎我无法将该芯片用于我的应用。  

    我查看了  DIX4192 的数据表、它确实具有 DIR 所需的输出信号、但没有在任何地方指定块起始帧与所述信号之间的延迟。

    我可以订购一个来测试此延迟是否存在。

    我必须说、虽然对于典型的 AES3、这种延迟不应该是一个问题、但我觉得很奇怪的是、同步信号的延迟这么多、而这种信号的典型用例是什么?

    感谢您的答复。
    Samuel

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    您好 Samuel、

    这些是成熟和流行的部件,但我没有找到任何关于 B 框架的事先查询 ,以给你更多的信息作为参考。  我只能说、  它可用于向解码 DSP 指示帧的起始位置 (您可以在数据表的第  33 页中阅读更多信息)   、也 可用于   在某些应用中同步音频和视频。

     如果您想要订购 DIX9211、我建议您订购 PCM9211、这是一款完全相同的器件、并具有额外的板载 ADC、稍后在 ADC 上可能会派上用场。

    此致、

    Arash

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    您好、

    是的、我同意这些都是成熟且众所周知的、我的应用程序可能超出了规范。

    订购 PCM9211 很可能是没有必要的、但我会记住这一点。

    谢谢、
    Samuel

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    您好、

    因此、在重新读取数据表并使用逻辑分析仪执行新的采集操作后、我可以确认我是白痴。

    这是晚了,我在阅读时感到困惑,并认为 这是 数据样本和 BFRAME 之间的延迟。

    我现在意识到、 延迟是系统的全局延迟、包括数据和同步信号。
    数据和 BFRAME 之间的延迟~17BCK。

    很抱歉、您造成的任何困惑、
    感谢您的帮助、
    Samuel