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[参考译文] TAC5301-Q1:如何设置音频编解码器 IC 上的频率

Guru**** 2629085 points

Other Parts Discussed in Thread: TAC5301-Q1

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/1586654/tac5301-q1-how-to-set-the-frequency-on-an-audio-codec-ic

器件型号: TAC5301-Q1

这是对案例编号“CS3070614"下“下的查询的跟进。

由于我无法再访问以前的支持主题、因此我正在提交一个新问题。

关于 TAC5301-Q1 的寄存器设置、我得知使用 PPC3 时存在限制、并且应使用“I2C Monitor“配置 GUI 中不可用的设置。

我想要实现的是将采样频率配置为 10.24kHz 并使 IC 相应地运行。

尽管 TAC5301-Q1 数据表中支持的值中未列出该特定频率、但该频率确实处于电气可编程频率范围内。

您能否提供详细说明、说明如何将 IC 配置为在 10.24kHz 的采样频率下运行? 我知道有两种方法可以设置频率:使用 GPIO1 或通过 I2S 提供时钟。 我更倾向于使用 I2S 方法。

此外、如果在使用不在官方支持值范围内的频率时存在任何顾虑或限制、如果您也能分享这些顾虑或限制、我将不胜感激。

感谢您的支持。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、

    如果您提供 BCLK 和 WCLK、此频率在本应用手册 https://www.ti.com/lit/an/slaaeg6a/slaaeg6a.pdf 中所述的“半自动模式“中受支持

    本质上、您将按照第 3.5.1 节所述选择正确的频段、对于 10.24kHz、该频段为 31、并且您可以 在寄存器 0x32 中选择“自动时钟配置“、内部器件时钟应自动配置。 我使用 EVM 用户指南中的示例脚本在 EVM 上对此进行了测试、并添加了选择半自动模式的一行:  

    #### Record AC-Couple Differential IN1-IN2 path ######
    # Target Mode, TDM, 32-bit
    # Primary ASI only, multiple of 48KHz Sampling
    #
    w a0 00 00 # Set page 0
    w a0 01 01 # Software Reset
    w a0 02 09 # Wake up with AVDD > 2v and all VDDIO level
    w a0 10 50 # Configure DOUT as Primary ASI (PASI) DOUT
    w a0 19 00 # 1 data input and 1 data output for PASI
    w a0 1a 30 # PASI TDM, 32 bit format
    w a0 1e 20 # PASI Ch1 on slot 0
    w a0 1f 21 # PASI Ch2 on slot 1
    
    w a0 32 7e #bin 31, 5% tolerance, auto clock config
    
    w a0 50 00 # ADC Ch1 diff input, 5KOhm, 2Vrms ac-coupled, audio band
    w a0 55 00 # ADC Ch2 diff input, 5KOhm, 2Vrms ac-coupled, audio band
    w a0 76 c0 # Enable Input Ch1 and Ch2, disable output channels
    w a0 78 a0 # Power up ADC and MICBIAS

    我能够使用此脚本测量好信号、而我的 AP 提供 10.24kHz WCLK 和 655.36kHz BCLK。

    如果您在控制器模式下运行此器件、其中只在 GPIO1 上提供 CCLK(也称为 MCLK)、那么这时我们需要使用手动时钟配置脚本才能生成正确的 BCLK/WCLK 和内部时钟。 我们需要执行这个手动时钟模式、因为器件不 是标准音频频率、所以不会自动知道如何生成 10.24kHz 音频时钟。 但是、如果像我之前介绍的那样提供时钟、器件将根据给定时钟的倍数生成正确的内部时钟、因此如果 BCLK 和 WCLK 成比例、其余时钟也会如此。

    如果您在这里需要更多帮助、请告诉我。

    此致、
    Mir