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[参考译文] TAC5112:关于输入信号

Guru**** 2872500 points

Other Parts Discussed in Thread: TAC5112

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/1585575/tac5112-regarding-the-input-signal

器件型号: TAC5112

您好的团队、

在实际器件上分别向 IN1P 和 IN1M 施加低于–0.24V 的电压 (n=1) 时、即使 DIN 上不存在数字音频信号、源自输入信号的信号泄漏也会发生在 OUT1P 和 OUT1M。
根据这个波形、您能解释导致这种症状的机制吗?

2.在数据表的第 6.3 节“建议运行条件“中、INxx 的下限为 0V。 但是、不使用 MIC 偏置时、引脚的直流电压为 VREF/2 = 1.375VDC。 此外、根据第 6.5 节“电气特性“、可施加到每个 Inxx 的满量程输入电压典型值为 1Vrms。 此时、下限电压变为 1.375 - 1.414 =–0.039V、该值低于建议工作条件下限 0V。
这是否意味着 TI 不建议应用满量程输入?

即使我们使用具有低 Vf 的肖特基二极管来限制 INxx 电压以处理过大的输入信号、我相信限值电压值可能上限在–0.3V 左右。 不过、由于这种现象发生在–0.24V 或更低的电压下、我认为在实践中很难避免。 你有什么想法? (如果您对将 Inxx 电压限制为 0V 有任何合适的建议,我将感谢您的指导。)

VREF (=2.75V) 的下限值是多少?

此致、
Ryu。

 

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    您好、

    输入应该能够从 0V 以下降至-.3V、而不会出现问题。 在-.3V 之后、ESD 保护二极管可能会短路或出现其他问题。 略低于 0 的摆幅适合运行。 我们不应该在-.24V 的输出端看到泄漏、就像这样、我想知道这是否是由于某种模拟耦合而不是通过器件造成的?  我在实验室中进行了测试、发现如果我的电线跨越输入/输出测量值、有时会像您所描述的那样从输入到输出出现一些泄漏、但这是电缆本身的模拟耦合。 当我使输入和输出电缆保持较远的距离时、输出引脚中的尖峰可以忽略不计。

    另外需要注意的是、您可以使用 ADC_CFG1 寄存器以及“PINCM_TRIM"来“来调整输入引脚上的共模。 这会略微增加引脚上的输入 CM、因此它不会摆动至低电平。  

    我要注意的一点是、当最大值为 2Vrms 时、有时该器件确实具有正增益误差、因此 2Vrms 输入可能会略高于 ADC 数字侧的 0dBFS。 当然、这只是一个非常小的量、但这可能会有一些问题。 如果我遇到 2Vrms 的“满量程“问题、那么我可以使用-.1dB、因此如果您遇到 ADC 过载问题、可以尝试使用该方法。 否则、在低于–0.3V 之前、任何低于 0 的摆幅都不是该器件的问题。

    此致、
    Mir

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    尊敬的 Mir:

    [引述 userid=“564139" url="“ url="~“~/support/audio-group/audio/f/audio-forum/1585575/tac5112-regarding-the-input-signal/6108838

    我想知道这是否是由某种模拟耦合而不是通过器件耦合引起的?  我在实验室中进行了测试、发现如果我的电线跨越输入/输出测量值、有时会像您所描述的那样从输入到输出出现一些泄漏、但这是电缆本身的模拟耦合。 当我使输入和输出电缆保持较远的距离时、输出引脚中的尖峰可以忽略不计。

    [/报价]

    这是否指电缆而不是接线模式?
    关于接线模式、引脚 15-16 和引脚 19-20 的模式之间的间隙设置为大约 2.5mm。
    与 TAC5112 芯片上的最小焊盘到焊盘间隙相比、这提供了大约两倍的间隙(约 1.3mm)。

    另一个需要注意的是、您可以 使用 ADC_CFG1 寄存器以及“PINCM_TRIM"来“来调整输入引脚上的共模。 这会略微增加引脚上的输入 CM、因此它不会摆动至低电平。  [/报价]

    当 ADC_PINCM_TRIM[1:0]设置为:
    01b = 500k
    10b = 250k
    它指出、相对于 VREF/2 = 1.375V、ADC 直流电压会进行细微调整(增量)。
    每个设置对应的电压变化是多少?

    4. VREF (=2.75V) 的下限值是多少?

    您还能告诉我这一点吗?
    可以接受误差范围内的答案。

    此致、
    Ryu。

    [/quote]
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    尊敬的柳山:

    首先 — 我说的是电缆。 如果布线不重叠、PCB 布局可能没有问题。 您能否分享显示此泄漏的测量值?

    其次、我认为这正在形成一个具有输入阻抗的电阻分压器、因此我们会增加 AVDD *(输入阻抗)/(引脚 CM TRIM +输入阻抗)、这将在 5k 输入阻抗和 500k CM 修整下提供~ 0.033V、或在 10k 输入阻抗和 250k 修整下提供 0.127V 等  

    VREF 预计在+/–3%的误差范围内、但不进行规格测试或保证。 这通常不是问题。

    您能否再次解释一下为什么输入电压低于 0V 对您的应用很重要? 在输入低于 0.3V 之前、它不会影响器件的运行。

    此致、
    Mir

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    尊敬的 Mir-san:

    感谢您的答复。
    我理解每一点。
    下面附上了在输出端生成的波形。

    黄色和绿色波形对应于 TAC5112 的 IN1P(黄色)/IN1M(绿色)输入。 光标(白色虚线)表示–0.3V 处的下限(绝对额定值)和开始出现症状的上限阈值(约–0.21V)。
    当输入信号升高到光标之间的区域(在绝对额定值范围内)或低于–0.3V(超出绝对额定值范围)时、OUT1P(粉色)/OUT1M(蓝色)处会出现输出。

    下面仅列出了要修改的寄存器。
    此外、请验证寄存器设置是否没有问题。

    寄存器地址 寄存器名称 寄存器
    0x01 SW_RESET 0x01
    0x02 VREF_CFG 0x09
    0x0A GPIO1_CFG0 0x00
    0x0D GPI_CFG 0x02
    0x0F Intf_CFG0 0x60
    0x10 Intf_CFG1 0x50
    0x19 ASI_CFG1 0x00
    0x1A PASI_CFG0 0x60
    0x1E PASI_TX_CH1_CFG 0x20
    0x1F PASI_TX_CH2_CFG 0x30
    0x29 PASI_RX_CH2_CFG 0x30
    0x32 CLK_CFG0 0x50
    0x34 CLK_CFG2 0x48
    0x35 CNT_CLK_CFG0 0x02
    0x36 CNT_CLK_CFG1 0x00
    0x37 CNT_CLK_CFG2 0xF0
    0x38 CNT_CLK_CFG3 0x80
    0x39 CNT_CLK_CFG4 0x40
    0x4D VREF_CFG1 0x00
    0x50 ADC_CH1_CFG0 0x00
    0x55 ADC_CH2_CFG0 0x00
    0x64 OUT1x_CFG0 0x20
    0x65 OUT1x_CFG1 0x20
    0x66 OUT1x_CFG2 0x20
    0x6B OUT2x_CFG0 0x20
    0x6C OUT2x_CFG1 0x20
    0x6D OUT2x_CFG2 0x20
    0x72 DSP_CFG0 0x98
    0x73 DSP_CFG1 0x98
    0x76 CH_EN 0x8C
    0x78 PWR_CFG 0xC0

    此致、
    Ryu。

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    尊敬的柳山:

    我可以明天在实验室中测试您的设置、看看我是否看到了相同的行为。 您还能尝试增大输入阻抗并告诉我这是否有作用吗? 这是寄存器 0x50。  

    此致、
    Mir

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    尊敬的 Mir:

    我将尝试修改寄存器。
    我正在等待测试结果。

    ]我要注意的是、以 2Vrms 运行的最大值是、有时此器件确实有正增益误差、因此 2Vrms 输入在 ADC 数字侧可能会略微超过 0dBFS。 当然、这只是一个非常小的量、但这可能会有一些问题。 如果我遇到 2Vrms 的“满量程“问题、那么我可以使用-.1dB、因此如果您遇到 ADC 过载问题、可以尝试使用该方法。 否则、在低于–0.3V 之前、任何低于 0 的摆幅都不是该器件的问题。

    请再次解释这一点。
    这是否意味着我们必须通过外部电路进行调整、以防止其超过满量程?
    这是否意味着只能在器件内部进行像“PINCM_TRIM"之类“之类的微小调整?
    与其他品牌,有一个利润,允许你使用它在 2Vrms 的极限,所以老实说,我觉得使用有点尴尬.

    此致、
    Ryu。

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    尊敬的 Mir:

    测试何时准备就绪?
    很抱歉、但我很匆忙、如果您能尽快告诉我结果、我将不胜感激。

    此致、
    Ryu。

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    尊敬的柳山:

    我已经在实验室中以几种方式对此进行了测试。 首先、我在 EVM 上使用了直流耦合模式来调整直流失调电压、因此安装了跳线 J15 和 J16。 我还调整了代码、在寄存器 0x50 中、我们可以设置 AC/DC 耦合模式、其中 CM 变化容差支持 500mVpp。 通过此设置、我能够向器件发送低电压、输入引脚上的示波器读数最小值为–300mV。 尽管如此、对模拟输出的影响非常小。 我确实在 AP 示波器的输出上看到了小尖峰、但在物理示波器上看不到、因为它非常接近本底噪声。  

    当我以交流耦合模式运行时、为了获得较低的最小模拟输入、我可以将电压提高到 2Vrms 以上、最终得到~–240mV 作为模拟输入的最小值。 发生这种情况时、我也会在模拟输出中看到一些反馈、但这当然超出了器件的规格、我们也会看到模拟输入上的 THD 更差、因为它是削波的。 为此、我在模拟输入端输入了 2.3Vrms 电压。  

    您的设置是什么? 您能否分享一个原理图并展示您的测量位置? 只有当直流耦合模式下的失调电压不正确时、我才能在模拟输出上获得任何信息。 使用差分输入时、这进一步偏斜。 但是、您的脚本显示了交流耦合差分模式。

    您应该能够在差分模式下使用高达 2Vrms 的器件、交流耦合、没有问题。

    当您调整探头长度或彼此之间的距离时、您能否检查输出中的小尖峰是否发生变化? 这是我发现的另一种串扰情况是通过导线物理反馈。

    此致、
    Mir

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    尊敬的 Mir:

    感谢您的答复。
    同时感谢您进行测试。
    我想通过私人消息讨论电路图、所以我已向您发送了一个朋友的请求。
    测量点是 TAC5112 的输入/输出引脚(输入:引脚 15 和 16、输出:引脚 19 和 20)。
    在测量期间、示波器探头的输入/输出未靠近器件。

    此致、
    Ryu。

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    您好、

    我给你发了一条消息。 我在 EVM 上直接连接到引脚的测试点进行测量。 您认为探头没有靠近设备是什么意思? 我想、如果来自您的输入和输出的导线相互干扰、这可能会导致问题。 能否确保您的输入是差分的、也许您可以将 P/M 线相互缠绕以消除输入或输出上的噪声。 将输入和输出分开。

    此致、
    Mir

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    尊敬的 Mir:

    我通过私人消息发送了电路图。
    关于探头、我想传达一点、我相信没有干扰、因为输入测量探头和输出测量探头保持了很好的分离

    此致、
    Ryu。

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    你好,我回答下午。  

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    尊敬的 Mir:

    我已通过 PM 发送其他信息。
    请回复。

    此致、
    Ryu

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