This thread has been locked.

If you have a related question, please click the "Ask a related question" button in the top right corner. The newly created question will be automatically linked to this question.

[参考译文] TAD5112:DAC 上电时、PLL 失锁

Guru**** 2770505 points

Other Parts Discussed in Thread: TAD5112, TAC5112EVM-K, TAC5112, TAD5212

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/1616012/tad5112-when-dac-is-power-up-the-pll-loses-lock

器件型号: TAD5112
主题中讨论的其他器件: TAC5112EVM-KTAC5112

我在设计中使用 TAD5112。  我正在评估 AC-MB /TAC5112EVM-K 平台上的芯片。

我将通过 TDM 接口将音频驱动到 TAC5112。  TDM 接口具有 (4) 个 16 位时隙。  BCLK 设置为 512kHz、FSYNC 为 8kHz。

当我在 PPC (TAC5x1x-Q1) 上为 DAC 接口上电时、我会注意到 PLL 损耗锁定。 在 PPC 的“GPIO/中断“选项卡中观察到失锁现象。  如果我使 DAC 断电并“更新“  中断状态、PLL 将返回到锁定状态。

我已经浏览了所有的时钟状态寄存器、任何设置都没有问题  

 

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    你(们)好  

    我的理解是您使用的是 AC-MB +  TAC5112EVM-K、并且它已通电并准备就绪。 一旦 发送 TDM 的接口上电、PLL 就会失去其锁定、如果您对 DAC EVM 下电上电、PLL 就会锁定。 是否也会丢失输出或只是标志熄灭?

    请注意、
    Arash

     

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    此外、如果  在关闭时信号已经进入 AC-MB + TAC5112EVM-K、然后为 AC-MB + TAC5112EVM-K 上电、会发生什么情况 ?

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    音频输出正确、并在 DAC 上电后保持稳定。  DAC 上电后、我检查 INT_LTCH0、我看到位 6 从 0 变为 1。   这也与我在 PPC 应用程序上看到的内容相关。

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    DAC 上电时、BLCK、FSYNC 和数据始终存在。  我启动 PPC 应用程序时、确实存在这些信号  

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Martin:  

    我认为它没有任何问题、因为 DAC 正常工作、这是在 PU 转换期间 、这些位在 读取后自行复位。  为了完整起见、您可以先打开 GUI、然后再打开 DAC 上电、再更新后的屏幕截图。  

    此致、

    Arash

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Arash、

    给你

    导通前的电压  

    DAC 上电并选择更新后

    我还通过 使用 I2C 监控器读取 INT_LTCH0(第 1 页、地址 0x34)来确认这种行为

    -马丁

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    谢谢 Martin、

    我使用我的可用 EVM ( TAD5212) 进行了尝试  、当 其激活时不会收到任何错误标志。  我 注意到您使用的 GUI 显示 TAC、但您的帖子标题是 TAD。 请 在下拉列表中使用正确的设备试用 、 这可能是导致此问题的原因。

    我还提供了 PPC3 版本、因为您使用的旧版本可能存在一些问题。

     此致、

    Arash

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Arash、

    很抱歉、我们正在使用 TAD5112 进行设计、但我们使用 TAC5112EVM-K 评估套件进行原型设计。

    我从外部 FPGA 板馈入 BCLK 和 FSYNC。  BCLK 为 512kHz、FSYNC 为 8kHz。  在 TDM 接口上有 4 个时隙。

    512kHz 的 BCLK 位于 PLL 范围的低端。  在这个较低的设置下、我们是否看到 PLL 有任何问题?  是否可以进行 4 插槽配置?

    -马丁

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Martin、

    表 6-7.  展示了支持的 FSYNC 和 8kHz 是它们之一。 使用以下公式使用 TDM4 和 16 位通道深度时、CLK 值没有任何问题。    BCLK=通道数 *通道 深度 * FS   

     我们在较低时钟设置下没有看到 PLL 的任何问题、您还表明尽管遇到了初始误差、但该器件仍然可以正常工作。  

     我自己也使用 8kHz 和 16 位来为 TDM4 尝试了它  的硬件版本和软件版本的这个 DAC 及其 EVM , 在这两种情况下, 他们都 工作正常。 我试过几次,芯片工作正常,甚至让它运行了几个小时。  我还读取寄存器 CLK_DET_STS0 寄存器(地址= 0x3E) 并 正确读取 8kHz、奇怪的是 我注意到我得到了 PLL 标志(可能我在第一次设置时没有正确更新寄存器)。  因此、该器件似乎可以与您的目标 CLKS 和 TDM4 配合使用。

    我将与我们的 PPC 团队核实   、因为我听说旧版 PPC 中存在问题。 如果我发现任何影响这个帖子,我会  更新这个帖子.  

    此致、

    Arash