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[参考译文] PCM3070:PCM3070 PLL在192 kHz FS时行为异常

Guru**** 2362840 points
Other Parts Discussed in Thread: PCM3070
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/582683/pcm3070-pcm3070-pll-behave-abnormal-at-192-khz-fs

部件号:PCM3070

大家好。

我们确实使用PCM3070作为数字混音器,它接收I2S将其与模拟信号混合并输出回I2S。
我们确实通过PurePath生成了一个脚本。 对于88.1k以下的所有采样速率,所有这些都非常有效。
遗憾的是,在96个或更高的FS时,会发出很大的噪音。 通过进行调试,我发现如果我们不使用PLL,就没有噪音。
但是,我没有找到正确的寄存器设置来使系统在较低的FS (没有PLL)下工作并提供高质量的声音。

以下是我们使用PLL的设置

(0x30,0x05,0x91);// P=1,R=1
(0x30,0x06,0x04);// J=4
(0x30,0x07,0x00);// D=00 (MSB)
(0x30,0x08,0x00);// D=00 (LSB)
(0x30,0x04,0x13);// PLL_CLKIN = BCLK,CODEC _CLKIN = PLL_CLK
(0x30,0x0B,0x81);// NDAC = 1,分配器通电
(0x30,0x0C,0x88);// MDAC = 8,分配器已通电
(0x30,0x0D,0x00);// DOSR = 128 (MSB)
(0x30,0x0E,0x80);// DOSR = 128 (LSB)
(0x30,0x12,0x01);// NADC = 1,分频器关闭
(0x30,0x13,0x88);// mAdc = 8,分配器通电
(0x30,0x14,0x80);// AOSR = 128

 MCLK =128*FS

BCLK =64*FS

有什么建议?

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    你好,Alexey,

    欢迎来到E2E,感谢您对我们的产品感兴趣!

    关于您的问题,寄存器0x04似乎没有正确编程,因为它正在写入一个保留值,并且正在将MCLK配置为PLL_CLKIN源,正确的值应该是0x07而不是0x13。 修复后,您需要确保PLL参数符合PCM3070应用参考指南第56页中提到的限制

    此致,

     -Diego Mel é ndez López ñ a
      音频应用工程师

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    谢谢Diego。

    这是一个很好的收获。 这意味着我们一直在使用MCLK。
    然而,这不是主要问题。 我们的问题是,我们有可变采样速率I2S信号,需要将其与模拟信号混合使用。
    当我们拥有44.1k,48K ECS时。到88.1k时,一切正常工作;但是,当我们获得更高的速率时,尤其是192k时,似乎我们开始超频音频编解码器。 因此,问题是,是否有任何通用寄存器设置来支持所有音质良好的速率。
    或者,是否有方法感应采样率变化和发生时的输出中断信号。 此外,如果能够对编解码器所看到的速率进行回读,将会非常好。

    此致

    Aleksey
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    您好,Aleksey,

    遗憾的是,无法让设备检测和报告所使用的采样率。 为了 获得良好的音频性能,应针对所使用的每个采样率正确配置PLL参数。 某些配置可以正确使用不同的采样率,但在某些情况下(如192K左右),PLL分频器应进行更新,以使参数符合规格。

    此致,

     -Diego Mel é ndez López ñ a
      音频应用工程师