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[参考译文] TAS5719：TAS5717/TAS5719的5719的MCLK和BCLK问题

admin
Guru**** 2390755 points
Other Parts Discussed in Thread: TAS5717, TAS5719

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/623438/tas5719-question-of-mclk-and-bclk-for-the-tas5717-tas5719

部件号：TAS5719
主题中讨论的其他部件：TAS5717，

您好，先生：

如我们所知，TAS5717/TAS5719的5719的MCLK和BCLK输入必须相互对齐。
请告知您，我们是否 可以将它们与 下面的图片中的下降边缘对齐？



谢谢，此致，

陈耀恩
2017年07月09日  

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    TI__Guru**** 2390755 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    你好，Wayne！ 我很清楚您的问题，作为一个从属设备，您只有MCLK输入TAS5717/9？ 您使用BCLK做什么...根据数据表，您的意思是SCLK (位时钟)吗？ 请参考： e2e.ti.com/.../2425.i2s-clock-requirements-on-tas570x1x2x3x-device-s 谢谢，Jeff
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    TI__Guru**** 2390755 points
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    您好，Jeff：

    感谢您的关注。 客户使用CPU的GPIO发送MCLK和BCLK。 它们的频率可满足TAS5719的规格，而MCLK和BCLK可在下降边缘对齐。 TAS5719现在可以正常工作，但如果存在此行为的潜在问题，我们现在不能正常工作。

    陈耀恩
    2017年08月09日
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    TI__Guru**** 2390755 points
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    你好，Wayne！ 您不应该这样做，但让Shawn来看看。

    Shawn您好！ MCLK的下降边缘是否存在对齐问题？

    谢谢，Jeff
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    TI__Guru**** 2390755 points
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    您好，Jeff：

    非常感谢。 您的意思是我们只能在TAS5717/19的上升边缘上对齐MCLK和BCLK吗？

    下降边缘：



    上升边缘


    谢谢，此致，

    陈耀恩
    2017年11月09日

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    TI__Guru**** 2390755 points
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    您好，Wayne：
    对于第一种情况(MCLK和SLK在下降边缘对齐)，这不是典型的应用。
    输入I2S采样率(44.1MHz/48kHz？)和单词withdth (32位？)有多高？ 如果SCLK在2.8224MHz ~ 24.576MHz的范围内，您可以将SLCLK信号用于MCLK。 这样，您就不需要在主机端生成MCLK信号。 我相信这是最简单的方法。
    此致，
    郑少文
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    TI__Guru**** 2390755 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    Shawn您好！

    感谢您的关注。 客户使用采样率为16kHz的32位I2S垫，因此我们无法将MCLK和BCLK连接在一起。 我们发现TAS5717/19在MCLK和BCLK对齐于下降边缘时起作用。 但是，如果产品线出现技术问题，我们建议客户不要这样做(尽管这是CPU的限制)。

    谢谢，此致，

    陈耀恩
    2017年11月09日
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    TI__Guru**** 2390755 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好，Wayne：
    从设计师的角度来看，此配置应该能够正常工作。 但实际上我们没有太多的测量数据，因为它不是典型的应用。 因此，我们无法确保此配置的稳定性/可靠性。
    此致，
    郑少文