[参考译文] Linux/TLV320AIC32X4SW-Linux：TLV320AIC3204

您好，

我想将tlv320aic32x4配置为作为播放从属设备(DAC)运行：

MCLK = 12MHz

WCLK = 4.41万[Hz]

BCLK = 1.4112 [MHz]

所有时钟都在编解码器外部的什么位置。应如何配置？

此致。

Diego，您好，
我的主机是一台Jetson TX2，它与Linux操作系统一起运行。 为Linux编写的嵌入式驱动程序将MCLK限制为12[MHz]，24[MHz]或25[MHz]，因此我不得不使用此时钟(我真的不知道为什么选择这些非标准MCLK时钟)。 其它时钟也由Jetson驱动至tlv320aic32x4。 我可能最终会将MCLK更换为更方便的时钟，但这需要修改驱动程序。

此致，
伊加尔

Diego，您好，

请提供上述情况的脚本吗？

此致，

伊加尔

Diego，您好，

感谢脚本我已根据脚本配置了编解码器，尽管我听不到连接到线路输出的扬声器发出的任何声音。 我可以看到DIN，WCLK，BCLK中的信号。

我还附上了我的设置图片。

请提供建议。

此致，伊加尔

Diego，您好，

我必须激活LOL和Lor，但听不到回放，但噪音很大。 请告诉我如何解决？

此致，伊加尔

Diego，您好，
我不得不关闭Mal和MAR，以减少大部分噪音，尽管声音不清晰且有点吵。
有什么建议？

此致，伊加尔

Dieg，您好，

最终，我通过降低寄存器 左/右DAC通道数字音量控制寄存器(寄存器65和66)中的放大率来实现这一功能。 现在播放的是完美的声音。

虽然此设置中存在问题：I2S通道具有数据输入线路和数据输出线路，它们共享相同的位时钟和帧时钟。 未使用主时钟。 这意味着，如果同一I2S接口上的编解码器需要D2A和D2D，则除非使用主时钟，否则仅在应用D2A时才起作用。 对吗？

此致，伊加尔。

Diego，您好，

我使用与昨天相同的配置重新运行系统，噪音再次出现。 您能否帮助确定噪音来源？

此致，伊加尔

您好，Igal，

感谢您的反馈。 我现在不在办公室，但会仔细查看您的意见，并在接下来的几天内回复您。   

此致，

 -Diego Mel é ndez López ñ a
  音频应用工程师

Diego，您好，

您能帮我解决噪音和编码问题吗？

此致，伊加尔

您好，Igal，

很抱歉回复延迟，我最近一直很忙。 我正在查看您的设置并有一些意见。

为什么使用与USB-MODEVM断开的编解码器？ 如果您将AIC3204编解码器用作主编解码器，并希望与扩展系统连接，则可以使用主板的接头J14来连接外部I²S Ω 信号， 您只需更改SW2的设置，即可将USB MCLK和USB I2S位设置为关闭。

线路输出上的噪音可能与所使用的寄存器设置有关，您能否共享所使用的设置？ 如果降低增益有助于解决噪音问题，则I²S Ω 信号可能已饱和。 您是否尝试过我之前建议的应用程序参考指南中的回放脚本？

DIN和DOUT是相同的I²S Ω 总线的一部分，其中位时钟和字时钟是共享的。 内部时钟是从此应用程序中的位时钟生成的，因此应始终提供。 我不认为您的应用程序会有问题，除非您有不同的A2D和D2A I²S接口，这在一般应用程序中是不常见的。

此致，

 -Diego Mel é ndez López ñ a
  音频应用工程师

您好，Igal，

感谢您的反馈。 当EVM连接时，您可以在主板的接头J6上连接来自控制器的I²C Ω 信号。 我正在查看提供的寄存器，但我担心缺少寄存器，编解码器寄存器映射由不同的页面组成，每个页面上包含256个寄存器，您共享的寄存器似乎仅用于第0页。 您是否可以只共享正在写入设备的寄存器，而不是完整的转储？

奇怪的是，编解码器以前工作良好，现在却不工作，这让我认为可能发生时钟错误。 能否验证从系统连接的信号？  

此致，

 -Diego Mel é ndez López ñ a
  音频应用工程师

Diego，您好，
头文件中的Linux驱动程序详细信息寄存器0-100，然后要访问第1页上的寄存器，它会添加128。在驱动程序中，没有对寄存器0的访问权限，而寄存器0是更改页面的门。 是否知道这一个原因？
伊加尔

Diego，您好，
我在尝试从设备获取寄存器时注意到的另一件事。 我设置第0页，然后读取128个寄存器并打印它们，然后设置第1页(写入'1'以寄存'0')并读取128个寄存器，两个集的值相同。 是否有其他选择页面的方式？
此致，伊加尔

Diego，您好，

我已经弄清楚了寄存器的问题，它们正由内核通过regmap机制来处理。

下面是映射到reg的寄存器列表(可以提取更多寄存器，但现在它提供了从第0页到第1页上的寄存器188的打印所有寄存器，如果您需要更多寄存器，请告诉我)。 我仍然在音频输出上遇到噪音问题：

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阿瑟：00
AC：00
广告：00
AE：00
AF：00
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B2：00
B3：00
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B5：00
B6：40
B7：00
B8：00
B9：40
BA：00
BB：80
BC：80

此致，伊加尔。

Diego，您好，

我认为问题是在建议的抽样方案中没有使用的渗透性MCLK，BCLK是PLL的来源。 是否有办法筛选出MCLK？

此致，伊加尔

您好，Igal，

很抱歉耽误了我假期的最后几天。

只要MCLK与PLL断开连接，就不应影响内部时钟方案，对于您的配置，只要BCLK有效并配置为PLL的源，就可以从设备上删除主时钟而不会出现问题 (从寄存器设置中可以看到什么是正确的)。

 此致，

 -Diego Mel é ndez López ñ a
  音频应用工程师