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[参考译文] TLV320AIC3007:TVL320AIC3007上的分布式模拟输出

Guru**** 2412280 points
Other Parts Discussed in Thread: TLV320AIC3007

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/682634/tlv320aic3007-disturbated-analog-outputs-on-tvl320aic3007

部件号:TLV320AIC3007

使用TLV320AIC3007音频编解码器(iMx6 + Linux)的主板存在一个大问题
为了突出显示问题,我们在DAC上播放一个带有I2S通道的“静音”文件(信号在1mn期间保持在0),并在立体声输出LOP_LEFT和LOP_RIGHT上进行路由。
与此弥散同时,将正弦应用于编解码器line2_LP和line2_RP的模拟输入信号。 R信道通过输出HPLOUT上的内部旁路直接进行路由,增益为0dB (输入振幅与输出相同)。 左通道未使用。
我们的问题是,对于正弦<0.4V RMS,一切正常:LOP_LEFT和LOP_RIGHT信号保持在0 V RMS。 有小噪音,但这不是问题。 正弦信号在HPLOUT上以相同电压输出。
在正弦波幅大于0.4V RMS (1.2Vpp)的情况下,LOP_LEFT和LOP_RIGHT信号(扩散“静音”的通道)会有很强的干扰(振幅高达150mV RMS)。 此信号是窦性信号的一部分,具有非常强的"失真"。

我不明白为什么信号会从一个信道传递到另一个信道,尤其是当此信号高于0.4V RMS时。 我们强烈怀疑内部饱和,但根据数据表,模拟信号的推荐工作值为0.707V rms!
您对此问题有什么想法吗? 提前感谢。

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    Martin,

    我在EVM上观察到了这种现象,只是当ADC输入被显著超出时。您提到输入信号为0.4VRMS,但您使用的是PGA吗? 如果是,收益是多少?

    此致,
    -Steve Wilson
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    您好,Steve,感谢您的回复。

    在 所有情况下,我都不使用PGA (R15和R16寄存器)的增益
    此外,在这种情况下:R81/R84/R88/ R91=静音

    此致

    弗朗西斯

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    您好,Francis,

    您能否提供注册配置?

    此致,
    -Steve Wilson
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    弗朗西斯

    我无法重现EVM上的问题。
    您是否仍遇到此问题? 如果是,请提供配置,以及输入和输出的一些范围快照。


    此致,
    -Steve Wilson
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    您好,Steve,很抱歉我迟到了回复,因为测试产品已发送给客户几天...

    现在,我会尽快提取登记册的价值。

    此致,

    弗朗西斯

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    您好,Francis:

    我还没有收到您的意见,幸运地获得了该配置吗?

    -Steve Wilson
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    您好,Steve,

    这一问题对我们来说已变得不那么紧迫。 但我希望能尽快把这些登记册的价值发给你们。

    此致

    弗朗西斯

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    弗朗西斯
    不用担心。 我将等待你的答复。

    此致,
    -Steve Wilson