[参考译文] TMDSDSK6713：多通道音频编解码器子板

您好Igor：

很抱歉回复太晚了。 您是否已为此项目选择开发板或构建自己的开发板？

1. 是否有至少12个音频输入(单声道)的子卡可用？

不是我所知道的-至少有12个音频输入... 但是，您可以找到每个具有4个通道的ADC/CODEC EVM，并将其连接到TMDSDSK6713子板管座中。

2. 主板是否同时支持所有指定的音频输入/输出？  换言之，我能否同时将独立音频流输出到耳机和线路输出？

原理图未显示AIC23编解码器的详细信息，但我认为您可以配置编解码器，使其仅将I2S流输出到耳机或同时输出。 但两者都可能是立体声。 我不相信您可以使用板载编解码器将独立的流输出到每个。 您可以绕过编解码器，将McASP/McBSP信号发送到子卡接头，并将其连接到2个单独的编解码器或支持4通道的编解码器/DAC。

3. 如果没有现成的子卡，将ADC输出从定制子卡发送到TMDSSK6713的最佳接口是什么？

我会购买编解码器EVM并将其连接到TMDSDSK6713上的J1和J3接头以进行初始原型设计，然后在之后构建一个自定义子卡。 请参阅下文。

4. 使用所有ADC/DAC和6713 DSP构建自定义板而不使用DSK是否更有意义？ 您可以使用6713和编解码器构建单个主板，但我会首先使用6713和编解码器的单独EVM进行原型设计。

TMS320C6713B支持两个McASP和两个McBSP，但它们是pinmuxed，因此您可以选择2个McASP或2个McBSP或1个McASP和1个McBSP。 我建议在这个项目中使用McASP。

两个McASP支持

-每个两个独立时钟区域(1 TX和1 RX)

-每个McASP八个串行数据引脚

从2-32个时隙传输TDM流

数据表表22. 外设引脚选择矩阵显示了McBSP和McASP之间的引脚互锁选项。

请参阅C6713B数据表： http://www.ti.com/lit/ds/symlink/tms320c6713b.pdf

以下是TMDSDSK6713的示意图： http://c6000.spectrumdigital.com/dsk6713/revc</s>6713

TMDSDSK6713有两个McASP端口，每个端口有8个串行化器，可用于串行输入或输出。 因此，总共有16个引脚，可连接到16个编解码器I2S数据输出(配置为单声道，尽管每个串行器可以传输立体声或TDM数据)。 所有编解码器都需要从属到相同的时钟和帧同步(1个时钟/FS对用于McASP1，另一个对用于McASP0)。

TMS320C6713DSK将所有McASP信号路由到J1和J3接头(见下文)，因此您必须连接一组编解码器EVMS，或者使用几个ADC或编解码器制作自己的子卡)。

您可以从PCM4204EVM输入4个通道，并通过两根电线连接到 为立体声I2S配置的2个串行器，将其输出到DSK6713。 将另外两个PCM4204EVM从到时钟主控器，以获得另外8个单声道。 您只需使用一个McASP即可完成12个信道。

http://www.ti.com/tool/pcm4204evm

或者，您可以考虑一个较新的设备，如PCM1865，它也可以为每个设备输入4个通道- http://www.ti.com/tool/pcm1865evm。 以类似的方式将其从属，并将其连接到6713DSK的J1/J3接头上，然后再将其连接！

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J1和J3管座上的McASP信号

AFSX0 - DC_FSX0 @J3

AFSR0 - DC_FSR0 @J3

ACLKX0 - DC_CLKX0 @ J3

ACLKR0 - DC_CLKR0 @ J3

AHCLKR0 - DC_CLKS0 @ J3 (不需要)

AHCLKX0 - DC_TINP1 @ J3 (不需要)

AXR0_7 - DC_FSR1 @ J3

AXR0_6 - DC_CLKR1 @ J3

AXR0_5 - DC_DX1 @ J3

AXR0_4 - DC_TOUT1 @ J3

AXR0_3 - DC_TINP0 @ J3

AXR0_2 - DC_TOUT0 @ J3

AXR0_1 - DC_DX0 @ J3

AXR0_0 - DC_DR0 @ J3

AFSX1 - HD2 @ J1

AFSR1 - HHWIL @ J1

ACLKX1 -接线@ J1

ACLKR1 - HRDYn @ J1.

AHCLKR1 - HD6 @ J1

AHCLKX1 - HD5 @ J1

AXR1_7 - HD1 @ J1

AXR1_6 - HDS1n @ J1

AXR1_5 - HDS2n @ J1

AXR1_4 - HD0 @ J1

AXR1_3 - HCNTL0 @ J1

AXR1_2 - HCSn @ J1

AXR1_1 - HCNTL1 @ J1

AXR1_0 - HRWn @ J1

此致，
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