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[参考译文] SRC4392:DIR锁定48 kHz和96 kHz输入,而不是44.1 kHz或88.2 kHz

Guru**** 2455560 points
Other Parts Discussed in Thread: SRC4392

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/717249/src4392-dir-locks-on-48-khz-and-96-khz-inputs-not-44-1-khz-or-88-2-khz

部件号:SRC4392

(我希望TI周围仍有人可以回答这个问题!)

我已构建了一个转换器板,我正在对其进行测试。 DIT端工作正常。

在接收端,设备配置为使用任何RX输入到DIR,该DIR向SRC馈送音频端口A。音频端口A是主端口,作为从端口向DAC馈送。

DIR,SRC和音频端口A都使用RXCKI作为参考时钟。 RXCKI由24.576 MHz振荡器驱动(也驱动DAC的MCLK输入)。

当连接到采样速率为48 kHz或96 kHz的S/PDIF或TOSLINK源时,DIR锁定,RXCKO (已启用用于监控,但未使用)以稳定的12.2880 MHz切换,我获得音频。

当源采样率更改为44.1 kHz或88.2 kHz时,DIR不会锁定(锁定变高)。 RXCKO输出~Ω 11.43 MHz时钟不稳定。

文档中的任何内容都不表示此配置不能正常工作。

初始化时,我将寄存器0x0D设置为0x00;位3将参考时钟设置为RXCKI,在操作过程中,如果用户选择另一个输入源,我将重新加载此寄存器。 但位3始终为0。

寄存器0x0E设置为0x11,使PLL2输出时钟驱动RXCKO,并且在接收器未锁定时不停止它。 (如果设置为0x01, 则RXCKO将在 切换到RXC/GO 44.1 速率后立即停止88.2。)

寄存器0x0F设置为0x21,寄存器0x10和0x11设置为零,根据数据表中的表4,接收器PLL1 P,J和D常量分别设置为2,8和0。

我做错了什么? 我应该在哪里查看?

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    您好,Andy:

    我确实查看了线程中提供的配置详细信息,但没有发现任何相同的问题。 我将在EVM上运行一些测试,以测试相同的测试,并研究断路器是什么,即44.1kHz采样率。

    在EVM上评估测试结果后,我将获得测试结果的更新。 谢谢。

    此致,
    Ravi

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    谢谢--希望能很快回来。
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    对此有何想法? 如果我有什么办法,我会开始玩寄存器,甚至可能在电路板上进行布线更改。 这应该"正常工作",对吗?
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    Ping,再次——我被卡住了,不知道接下来该怎么做。
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    每周ping。 有人在家吗? 我对TI对这些部件的支持没有信心。

    这似乎有一个简单的原因导致它不起作用。 我已检查注册设置,但看不到我正在执行的任何看起来不正确的操作。 我甚至还在寻找其他使用此部件的评估版和whatnot,希望该代码可用。 例如 ,TAS3251EVM 使用SRC4392,查看  此EVM的原理图,我发现SRC4392是通过XMOS部件的I2C配置的。 我有XMOS工具,我会查看该部件的代码,但在任何地方都没有链接。

    SRC4392EVM 看起来需要用户从主机程序中设置所有寄存器设置,因此在确定需要加载哪些寄存器和值时没有帮助。

    这种设计应该在一个月前就已经启动并运行了,但没有任何提示,我将要放弃它。 Xmos有一个SRC内核,应该能很好地工作。

    同样,问题很简单:DIR锁定采样率为48 kHz的输入,但不锁定采样率为44.1 kHz的倍数的输入。 参考时钟为24.576 MHz。 数据表中没有任何内容表明我需要将参考时钟切换为22.5792 MHz (或11.2986 MHz),并且这样做需要一些白色电线和另一个振荡器。

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    您好,Andy:

    抱歉,无法解决问题,请按数据速率。 在我的最后,我尝试了一些实验,但也无法得出结论。 我对零件有问题的部分原因是,我们没有处理此零件的设计团队进行咨询。 因此,我无法及时帮助你。

    我再次表示歉意。 我将继续查看SRC系列的内部详细信息,并在确认后解决DS版本中的断开连接。

    谢谢,此致,
    Ravi

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    我做了一些不确定的测试。 如果我已经安装了硬件,我真的不想把钱花在评估版上。

    您是否使用44.1 kHz输入和24.576 MHz参考时钟进行了测试? 要么锁定,要么不锁定。 在我的情况下,它永远不会。 我可以用我的主板来做22.5792 MHz参考时钟,但这并不容易。

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    仍未解决。 我要再建一个电路板--也许我的第一篇文章中的SRC4392有一些损坏? 我会向大家汇报。
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    您好,Andy:
    我将使用EVM在我的端测试相同的测试,并将向我报告。 对此问题表示抱歉,因为我们目前没有此设备的设计支持,并且必须根据工作台评估提供支持。

    此致,
    Ravi
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    我会购买评估平台,但它似乎是多余的,尤其是考虑到它需要连接到主机计算机以进行注册下载。

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    我今天有机会处理这个问题。

    起初,我认为RXCLKI输入可能是用作DIR参考时钟的不好选择,尽管它是默认值。 我遇到了几种使用SRC4392的设计,无论出于什么原因,它都被配置为使用MCLK输入,而不是RXCLKI输入。

    请注意,我的初始设计使用由24.576 MHz振荡器驱动的RXCLKI。 DIR PLL1配置寄存器设置为数据表指定的值P = 2,J = 8和D = 0。

    对我来说,将设计配置为使用MCLK而不是RXCLKI作为参考时钟非常简单。 我设计的另一个优点是MCLK具有两种可能的输入时钟频率:22.5792 MHz和24.576 MHz。 我做了一个快速的代码旋转,并进行了一些测试。 MCLK设置为24.576 MHz时,DIR仅锁定48 kHz的倍数采样率,就像我使用RXCLKI作为参考的测试一样。 MCLK设置为22.5792 MHz时,DIR不会锁定,这是在PLL配置下的预期情况。

    我接下来想,我应该测试使用22.5792 MHz的MCLK作为DIR参考,并根据数据表为该频率设置PLL1配置。 这意味着D = 7075,而不是0。 在此模式下,DIR能够可靠地锁定所有采样速率32 kHz,44.1 kHz,48 kHz和88.2 kHz,但对于96 kHz来说不可靠。

    在不更改PLL1配置的情况下,我将MCLK设置为24.576 MHz。 我以为这是完全不可靠的,但是! 它完全稳定,并锁定了所有采样率。 这是一个惊喜。

    作为最终测试,我将DIR重新配置为使用24.576 MHz下的RXCLKI作为DIR PLL1参考,但我将PLL配置保留为22.5792 MHz指示的值。 即D = 7075,而不是零。 我们有一个赢家——DIR锁定了32 kHz到96 kHz的所有采样速率。

    我不明白。
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    一次最终测试。 22.5792 MHz RXCLKI的PLL1设置不会锁定192 kHz。 如我所述,低频率锁定。

    是时候建立另一个主板了,看看是不是芯片本身应该受到责备。