[参考译文] PCM1808-Q1：大约超过数据表中给出的 tr/TF 限制

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https://e2e.ti.com/support/audio-group/audio/f/audio-forum/1113341/pcm1808-q1-about-exceeding-the-limit-of-tr-tf-given-in-the-datasheet

器件型号：PCM1808-Q1

大家好、团队、

对于 PCM1808QPWRQ1的 I2S 信号的 tr/TF、我们想了解两点。

数据表规格为20ns (最大值)；如果超出该限制、会发生什么情况？
我们需要考虑哪种风险？
是否可以提供可能使用 EVM 测量的 TR/TF 的实际限值？
我们知道、即使实际值大于20ns、我们也可以保证数据表中提供的值。

这个问题的背景是、我们希望减少 I2S 的 bck、作为 EMC 的对策。
当我们在设置中实际测量时、tr/tf 为~24ns ...我们希望确保这是否有潜在风险。

此致、
Masaru Oinaga

1 年多前

0 admin 1 年多前

TI__Guru**** 667810 points

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您能否向我发送您的时间安排的详细信息？

0 admin 1 年多前

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您好、Sanjay、

时序意味着什么？
我们想知道、如果 tr 和/或 tf 超过20ns (最大值)、会发生什么情况。

最棒的
Masaru

0 admin 1 年多前

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我想知道 BCLK 和 LRCLK 频率。

0 admin 1 年多前

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您好、Sanjay、

⇒LRCLK＝48kHz

BCLK＝3.072MHz

此致、
Masaru

0 admin 1 年多前

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我们正在与设计团队进行核对。将很快作出响应

0 admin 1 年多前

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您处于从模式吗？

0 admin 1 年多前

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让我们假设从机模式。

在 BCK 输入上为24ns 时、低电平时间为138ns。数据在 bck 的下降沿之后更改 TCKDO (40ns)。在 bck 的下一个上升沿之前、数据出现的时间略大于100ns。

通常、读取数据的处理器将在 BCK 的上升沿锁存。数据的设置时间应小于(138-40-24)或70ns。如果它具有此值、那么我猜24ns 应该是可以的。

0 admin 1 年多前

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您好、Sanjay-San、

客户的设置是从机模式。

您的解释很清楚、我们能够解决问题。

最棒的
Masaru

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[参考译文] PCM1808-Q1：大约超过数据表中给出的 tr/TF 限制