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[参考译文] TLV320DAC3203:PDM 时钟信息

Guru**** 2524460 points
Other Parts Discussed in Thread: TLV320AIC3204, TLV320DAC3203

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/1016879/tlv320dac3203-pdm-clock-information

器件型号:TLV320DAC3203
主题中讨论的其他器件:TLV320AIC3204

我介绍了 DAC3203电气规格、并注意到它没有列出 PDM 时序信息。 因此、我参考了 AIC3204数据表中的规格。 DAC3203中的 PDM 块规格是否与 AIC3204中的规格相似?  

此外、我还想对一些参数进行一些澄清、 以检查我的理解。 AIC3204技术规格表附件中列出的时钟上升/下降时间是指编解码器引脚分配的时钟仿真性能。 因此、我们预计降级可能会超过列出的4ns 时序、并且 PCB 寄生效应会产生额外的电容。 这种说法是否正确?

 e2e.ti.com/.../TLV320DAC3202-Questions-with-Graphic.pdf

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    大家好、Ivan、我之前看到过您回答过有关该部件的问题、您能评论一下这个问题吗? 谢谢。

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    尊敬的 David:

    我认为可以将 TLV320AIC3204规范用作 TLV320DAC3203的参考。
    正确、在考虑布局和设计上其他组件的时序时、预期会有一些差异、该规格基于仿真。

    此致、
    -Ivan Salazar
    应用工程师