[参考译文] TLV320AIC3101：寄存器设置

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/988119/tlv320aic3101-register-setting

器件型号：TLV320AIC3101

您好！

我的客户正在评估其电路板上的 TLV320AIC3101、但其 ADC 功能和 DAC 功能不起作用。

MCLK 和 BCLK 是常见的、BCLK 为2.048MHz、FS 为8kHz。

您能否检查以下设置寄存器？

e2e.ti.com/.../TLV320AIC3101-Registers.xlsx

我们是否应该检查其他内容？

此致、

Kuramochi

4 年多前

0 admin 4 年多前

TI__Guru**** 2382480 points

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您好 Kuramochi-San、

感谢您提供寄存器配置、但我首先有一个问题。这是 I2C 寄存器转储还是客户发送到器件的寄存器写入列表？

假设这是一个 I2C 转储、下面是我的注释：

-左侧和右侧 ADC 均已通电、PGA 已取消静音。这很好。我希望 DOUT 上会有一些数据。情况不是这样吗？

- MIC2L 连接到左侧 ADC，MIC2R 连接到右侧 ADC。这些是客户打算使用的输入吗？

- PLL 被启用并配置为2.048MHz 的 BCLK，这是很好的。

-左侧和右侧 DAC 均已通电并取消静音、并使用 DAC_L3/R3路径。没关系。

-我看到线路输出驱动器在寄存器86和93中断电。驱动器功率由这些寄存器中的位 D0控制、并且应该被设定为1。请将0x0B 写入寄存器86和93。我知道 bit-D0显示为只读寄存器、但这是一个拼写错误、它是一个读取/写入寄存器。

-在寄存器102中、请写入0xA2以使用 BCLK 作为主时钟源。

如上所述、我希望 DOUT 显示数据、因为 ADC 已通电且 PGA 已取消静音。您能否提供 ASI 总线(BCLK、WCLK、DOUT)的示波器捕捉？客户似乎也在计划使用 TDM 并针对 DSP 模式进行配置。 WCLK 应该是一个位宽的脉冲。

此致、
Aaron Estrada

0 admin 4 年多前

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器件型号：TLV320AIC3101

您好！

我的客户正在评估其电路板上的 TLV320AIC3101、但其 ADC 功能和 DAC 功能不起作用。

MCLK 和 BCLK 是常见的。

在这种情况下、对于启动序列(电源、时钟、设置寄存器、移除复位)是否有任何限制？

此致、

Kuramochi

0 admin 4 年多前

TI__Guru**** 2382480 points

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您好 Kuramochi-San、

我相信这篇 E2E 帖子与您的另一篇帖子有关。是这样吗？我已添加以下链接。

https://e2e.ti.com/support/audio/f/audio-forum/988119/tlv320aic3101-register-setting/3650165#3650165

如果可以、我认为最好将同一主题的问题保留在同一帖子中、如果您可以的话。我将在这里发表意见，但我们可以在原来的帖子中继续讨论。

关于您对启动序列的影响、我们很理想、很显然希望器件先通电、同时将复位保持在低电平、直到所有电源完全通电。时钟和寄存器设置可能会影响数据是否可以发送和接收、这在原始帖子中有提及。

此致、

Aaron Estrada

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[参考译文] TLV320AIC3101：寄存器设置