[参考译文] PCM1864-Q1：增益问题

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/998136/pcm1864-q1-gain-problems

器件型号：PCM1864-Q1
主题中讨论的其他器件：PCM1864

大家好！
我们的输入信号有问题、我们有以下连接方案：麦克风连接到 CH1 L、带分频器的扬声器信号连接到 CH2 L。问题如下：麦克风信号的放大率针对任何通道(CH1 L / CH2 L)进行了正确调节、并且扬声器在任何数字或模拟增益值下的信号电平都保持在极低的水平、几乎听不到。我曾或两次观察到一张图片、显示在最大数字增益下信号非常强、但现在这仍然不起作用。请告诉我您对此有什么想法吗？

BES 此致、
Georgy Zagoruiko

3 年多前

0 admin 3 年多前

TI__Guru**** 1127450 points

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您好、Georgy、

您能否提供 PCM1864-Q1中的寄存器详细信息以及 ADC 周围区域的原理图？

0 admin 3 年多前

TI__Guru**** 1127450 points

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大家好、Tom！感谢您的回复！

我没有看到您的答案...

对于没有扬声器信号连接的 MIC、PCM1864设置工作正常。我稍后会向您发送原理图

0 admin 3 年多前

TI__Guru**** 1127450 points

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0 admin 3 年多前

TI__Guru**** 1127450 points

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{0x00, 0xFE}, /* Reset the registers */
{0x00, 0x00}, /* Set register page to 0x00 */
{0x60, 0x0},  /* Turn off energy sense */
/* Clock settings for 16KHz */
{0x20, 0x32}, /* SCK_XI_SEL=SCK|Xtal, MST_SCK_SRC=PLL, MST_MODE=Master, ADC_CLK_SRC=SCK,
                 DSP2_CLK_SRC=SCK, DSP1_CLK_SRC=PLL, CLKDET_EN=Disable */
{0x21, 0x0B}, /* PLL to DSP1 Divide value = 1/12 */
{0x22, 0x03}, /* SCK to DSP2 Divide value = 1/4 */
{0x23, 0x0B}, /* SCK to ADC Divide value = 1/12 */
{0x25, 0x07}, /* PLL to SCK OUT divider = 1/8 */
{0x26, 0x0B}, /* SCK to BCK divider = 1/12 */
{0x27, 0x3F}, /* BCK to LRCK divider = 1/64 */
{0x29, 0x07}, /* P Divide value = 1/8 */
{0x2A, 0x01}, /* R Multiplier value = 2 */
{0x2B, 0x10}, /* J Multiplier value = 16 (Integer part of K=J.D) */
{0x28, 0x01}, /* PLL_REF_SEL=SCK; PLL_EN=Enabled */
{0xFF, 0x0},  /* wait for PLL to lock */
{0x19, 0xFF}, /* Manual gain mapping */
{0x01, 0x0},  /* PGA CH1_L */
{0x02, 0x0},  /* PGA CH1_R */
{0x03, 0x0},  /* PGA CH2_L */
{0x04, 0x0},  /* PGA CH2_R */
{0x0F, 0x36}, /* Digital PGA CH1_L (7dB) */
{0x17, 0x28}, /* Digital PGA CH2_L (0dB) */
{0x06, 0x41}, /* Polarity: Normal, Channel: VINL1[SE] */
{0x07, 0x44}, /* Polarity: Normal, Channel: VINR3[SE] */
{0x08, 0x42}, /* Polarity: Normal, Channel: VINL2[SE] */
{0x09, 0x48}, /* Polarity: Normal, Channel: VINR4[SE] */
{0x0B, 0x0C}, /* TX WLEN: 16 bit; FMT: I2S format */
{0x10, 0x03}, /* GPIO0_FUNC - SCK Out; GPIO0_POL - Normal */
{0x11, 0x50}, /* GPIO3_FUNC - DOUT2; GPIO3_POL - Normal */
{0x12, 0x04}, /* GPIO0_DIR - GPIO0 - Output */
{0x13, 0x40}  /* GPIO3_DIR – GPIO3 - Output */

0 admin 3 年多前

TI__Guru**** 1127450 points

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ADC 架构的扬声器信号

0 admin 3 年多前

TI__Guru**** 1127450 points

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大家好、Georgii、

需要考虑的一点是、PCM186x 的单端输入阻抗为10kOhm、这将严重影响所示的电阻分压器。实际上、分压器分压比从0.133变为0.025、这意味着由于 ADC 的负载、信号小了近5.5倍。您可能希望使用更小的电阻值(从功耗的角度来看可能不需要)、或者在 ADC 之前缓冲扬声器信号。

最棒的

Zak

0 admin 3 年多前

TI__Guru**** 1127450 points

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大家好、Zak！

感谢您的回答！

我明白为什么信号可能非常小、但为什么我的增益会跳转？
在一种情况下、如果来自扬声器的信号具有正常(预期)增益、则麦克风信号过高(尽管它设置为正常增益、例如-15dBFS)。
否则、如果麦克风信号具有预期增益(-15dBFS)、则来自扬声器的信号极小。
如果您获得正确的时间、那么两个信号有时会获得正确的放大效果。

此致、

Georgii Zagoruiko

0 admin 3 年多前

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大家好、Georgii、

我认为您的 DSP2时钟可能存在问题。是否可以尝试将 SCK 到 DSP2分频器设置为6而不是4？此外、该器件具有自动时钟配置功能、因此您无需手动配置分频器。是否有理由不使用此功能？

最棒的

Zak

0 admin 3 年多前

TI__Guru**** 1127450 points

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你好、Zak、

感谢您的快速回答！

我以更好地了解设置的方式设置 ADC。您可以尝试将设置恢复为原始设置。您为什么认为 DSP2可能存在问题？我的好奇心:)

在没有来自扬声器的连接信号的情况下、一切都可以稳定工作...

我将尝试将 SCK 到 DSP2分频器设置为6而不是4、但这需要时间。

此致、

Georgii Zagoruiko

0 admin 3 年多前

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嗨、Georgii、

我将使用 PLL 计算器工具作为参考、DSP2时钟应是 DSP1时钟的一半。以下是理想设置。

最棒的

Zak

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