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器件型号：TLV320ADC6140 大家好、
我想了解优化 TLV320ADC6140的 DRE 性能的工作原理。
1."DRE 最大增益"设置如何影响性能？
您能给我一条引导线来选择最佳设置吗？
2.当输入电平降至 DRE 触发阈值电平时、DRE 如何增加通道增益？
它会增加到 DRE 最大增益、还是以线性方式增加通道增益？
此致、
大家好、
我想了解优化 TLV320ADC6140的 DRE 性能的工作原理。
1."DRE 最大增益"设置如何影响性能？
您能给我一条引导线来选择最佳设置吗？
2.当输入电平降至 DRE 触发阈值电平时、DRE 如何增加通道增益？
它会增加到 DRE 最大增益、还是以线性方式增加通道增益？
此致、
Shinji-San、
DRE 遵循以下左图中显示的增益变化曲线(内部 PGA 增益)：
基本上、当输入信号超过阈值时、DRE 会增加馈入 ADC 的 PGA 的增益、使信号增益保持在阈值电平、直到达到最大增益。 DRE 以升采样率监测信号、以尽可能密切地跟踪信号。 输出电平上的增益在采样率下撤消以保持单位增益、因此输出电平不显示任何增益变化。 右上角的图显示了这一点：ASI 输出电平。
DRE 具有一些参数、可通过攻击(信号增大时减小 PGA 增益)或释放(信号减小时增大 PGA 增益)来控制其对信号变化的反应速度。 《使用 TLV320ADC5140/6140中的动态范围增强器的应用手册》中对这些内容进行了说明：
这些参数在 PPC3 GUI 中不可调、但可以通过 PPC3的 I2C 监视器窗口中的 I2C 命令进行更改。 随附的 Excel 电子表格将为这些参数生成相应的寄存器写入。
当大信号摆动超过阈值时、可能会发生瞬时不连续性。 上述参数可用于最大程度地减少不连续性。 例如、如果经常来回突破阈值、则使用迟滞和去抖来最大程度地减少不需要的连续多个增益变化。 为了防止多个连续增益变化、请将释放设置为慢速。 为了获得最佳效果、请将发布量保持在攻击和去抖次数的100到00倍以上。
攻击和释放去抖设置取决于输入信号在低信号和大信号之间切换的频率。 如果一个信号在两个电平之间重复交替、这可防止 DRE 在增益的增加和减少之间振荡。
如果阈值过高且最大增益较大、则输入信号可能会显著升高并在 ADC 输入端削波、从而增加失真。 为了防止 ADC 的输入信号削波、请将攻击设置为快速、并设置具有足够裕量的阈值。 此外、将阈值 A 10-20 DBS 设置为小于最大增益。 因此、将阈值保持在-54dB 左右可提供足够的裕度、最大增益为24dB。 但是、将阈值设置为-24dB 并将最大增益设置为30dB 可能会超过 ADC 最大输入电平。
此致、
佩德罗
