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[参考译文] TAS6424-Q1：如何在加电和断电过程中处理待机引脚？

admin
Guru**** 2481465 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/837356/tas6424-q1-how-to-handle-the-standby-pin-during-power-up-and-power-down-process

器件型号：TAS6424-Q1

大家好、

我想知道如何在加电和断电过程中处理待机引脚、您能在以下问题上提供帮助吗？

1.在上电过程中、何时可以上拉待机引脚？ 在 VBAT 和 PVDD 准备就绪后？ TDM 是否也应该就绪？ 您能否提供时序图或波形、以便更轻松地解释上电过程？

2.拉高待机引脚后能否立即写入 I2C？ 如果没有、我应该等待多长时间才能写入 I2C？

3.在断电过程中，我是否应该先下拉待机引脚，然后移除电源？ 您能否提供正确的断电时序图？

非常感谢你的帮助。

BR、

Arie

  • 0
    TI__Guru**** 2481465 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Arie、

     对于您的问题：

    1.在上电过程中、何时可以上拉待机引脚？ 在 VBAT 和 PVDD 准备就绪后？ TDM 是否也应该就绪？ 您能否提供时序图或波形、以便更轻松地解释上电过程？

      是的、您可以在 DVDD、VBAT 和 PVDDr 准备就绪之前上拉待机状态。 无需 TDM 就绪。

    2.拉高待机引脚后能否立即写入 I2C？ 如果没有、我应该等待多长时间才能写入 I2C？

       建议首先上拉待机、然后使 DVDD 稳定。 然后您可以启动 I2C。

    3.在断电过程中，我是否应该先下拉待机引脚，然后移除电源？ 您能否提供正确的断电时序图？

       在移除 PVDD、VBAT 或 VDD 之前，将待机低电平设置为>15mS。

    此致

    Linda

  • 0
    TI__Guru**** 2481465 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好 Linda、

    非常感谢您的回复。 另一个问题是、在移除 VDD、VDD 的 VBAT 之前、为什么需要15ms？ 因为从数据表中可以看出、"如果器件尚未处于高阻态、则输出在5ms 内下降。" 客户感到困惑、为什么需要额外的10ms。  这是用于优化某种性能吗？

    BR、

    Arie

  • 0
    TI__Guru**** 2481465 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Arie、

    需要15ms。

    我们可以 通过电子邮件讨论该主题

    此致、

    Derek