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[参考译文] PCM5142:未上电/自动 PLL 不工作

Guru**** 1646690 points
Other Parts Discussed in Thread: PCM5142
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/1309876/pcm5142-not-powering-on-automatic-pll-not-working

器件型号:PCM5142

您好!

我将3线 I2S 配置与 PCM5142配合使用。 处于 I2C 模式。 I2S 和 I2C 的主器件是 QCC5125 (BTM525)。 我根据下面的原理图为 PCM5142制作了一个 PCB、没有音频。 VNEG 为0.5V、而不是-3.3V。 DVDD、CPVDD 和 AVDD 为3.3V。 LDO 为1.9V。 问题与源(QCC5125)无关。 我检查了主源的时钟输出和 I2C 总线、它们工作正常。 DOUT 还将数据输出到 PCM5142的 DIN 中。 感谢任何帮助。

原理图:

PPS:

WCLK 时钟:

BCLK 时钟:

PPS 代码:

e2e.ti.com/.../8055.base_5F00_main_5F00_Rate48.cfg

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    Goose、您好!

    • 我注意到、您在2个输出端具有不同的电容值。 此外、我还进行了快速计算、 使用100nF 时、Fc=1.5915KHz 、而使用27nF 时、滤波器 将得到 Fc=5.8946KHz。 请检查您正在考虑的音频频率带宽。  我建议 在这两种情况下均使用470Ohm+2.2nF。
    • 您可以   在 VCOM 上使用较小的电容、如10uF、
    • 如果使用内部 LDO (来自片上 LDO 的输出),则  应将0.1-µF 去耦电容器与
    • 如果您有兴趣、可以查看 TI 应用手册  SLVA689 - 2015年2月  以更准确地计算 I2C 信号的上拉电阻器
    • 从 LRCK 和 Bit Clk 来看、您似乎是在将每个通道32位深度与48kHz LRCLK 配合使用。 这是您的计划吗?
    • 如果您要将器件设置为主模式、  则 SCK 是输入 BCK/LRCK 是输出 。 请参阅第8.3.6.6节"音频速率主时钟"中的时钟主模式。 我在您的帖子中没有看到 SCK 率。 您能否确认 您已提供了
    • PCM514x 具有带有小数倍乘法的片上 PLL、可生成 IC 内的各种模块所需的时钟频率 、例如音频 DAC 和负电荷泵、 电荷泵的 clk 似乎不正确、这可能是因为 PLL 系数设置不正确。 我无法查看附加的 cfg 文件(似乎 它 被阻止了此类型的文件!)  请参阅 表133。 (PLL 作为主时钟(VCOM 模式)的建议时钟分频器设置) 、并确保针对给定 SCK 的寄存器设置正确。

    此致、

    阿拉什

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    尊敬的 Arash:

    感谢您的答复。 C28和 C29的输出电容值是错别字。 两者在 PCB 中实际上均为2.7nF。 我对这种困惑深表歉意。 我仅使用48kHz 的采样率、因此该配置应该可以正常工作。

    主时钟 SCK 是未使用的、因为根据 PCM5142数据表、3线 I2S 配置(自动 PLL 配置)不需要它。

    您如何确定输出是32位的? 主器件(QCC5125)实际上仅输出48kHz、24位 I2S:

    PCM5142正在从模式下使用。 但是、在使用正确的时钟时、PCM5142无法自动配置 PLL。 下面是 PPS 代码的.txt 文件、因为.cfg 会引起问题:

    e2e.ti.com/.../base_5F00_main_5F00_Rate48.txt

    谢谢!

    古斯

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    您好!

    对于这些电容器、应该可承受2、7nF 的电容。  

    如果  您将该部件用作从模式3Wire I2S、 而不是主模式、则 不需要 SCK、您可以使用 bck。(请参见 图65。 PCM514x 时钟分配树)来设置器件

    BCK 可以计算 为 通道数 x 通道深度(位) x LRCLK,因此  对于3.07MHz BCK 和48K 采样率以及立体声(2通道),分配的(分配的)通道深度为32。  当然、您可以发送具有8位边界填充的24位数据。 我使用 AP 、这里是它的屏幕截图。 请注意、分配的通道深度为32、但我将向此时隙发送一个24位数据、因此 AP 用8位对其进行填充。

    我看到您使用的是 bck 比例因子64、我认为它 将 信道分配设置为32 位(x2)、并且您正在发送24位数据; 所以我认为没关系。  

    您需要确保 数据格式 正确。 在  脚本中  ,我看到 w 98 28 00 ,这意味着你的数据是 I2S 格式 ,但在你拥有的屏幕截图中, 它是 LJ。 请确认它们是否匹配(我不熟悉您使用的工具、因此可能是正确的、 但只需仔细检查)最佳方法是同时使用图 bck、LRCK 和 Din、并检查其边缘以确保其 采用 I2S 格式(请参阅数据表的图16)

    如果一切都正确、那么您应该像前面提到的那样检查 PLL 系数。 请参阅 表34。 PLL 配置寄存器和第 8.3.6.5节 介绍了 PLL 计算示例。

    个人而言,我喜欢先提供 SCK 并禁用 PLL 并检查 DAC 的功能 ,一旦它工作,然后我 移除 SCK 并启用 PLL ,这样,如果 DAC 不再工作, 那么 我知道 问题 是 PLL 设置/系数。  您可以从脚本中读取 PLL 系数寄存器、然后使用本部分中的公式 查看所有结果是否 符合您的预期。

    此致、

    阿拉什

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    尊敬的 Arash:

    感谢您的帮助。 无论如何、我都无法使自动 PLL 工作。 相反、我手动编写 PLL 数据、之后一切都按预期运行。 另外、感谢您指出左对齐设置。 这帮我解决了后面的一个问题。

    古斯