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[参考译文] TLV320ADC6140:采用默认设置时 DRE 导致失真

Guru**** 1693050 points
Other Parts Discussed in Thread: TLV320ADC6140
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/audio-group/audio/f/audio-forum/1322685/tlv320adc6140-dre-causing-distortion-with-default-settings

器件型号:TLV320ADC6140

您好!

我目前正在推出一款采用 TLV320ADC6140的原型、用于某些线路输入音频和在 TDM 上输出。

差分音频交流耦合到 ADC、以下是启动时配置的 I2C 设置:

// Wake from Sleep and use internal AREG
TLV320ADC_I2C_REG_SLEEP_CFG = 0b10000001;

// configure channel 1 as line input and enable DRE
TLV320ADC_I2C_REG_CH1_CFG0 = 0b10000001;

// Enable Channel 1 Serial Output
TLV320ADC_I2C_REG_ASI_OUT_CH_EN = 0b10000000;

// Power up ADC and PLL
TLV320ADC_I2C_REG_PWR_CFG = 0b11100000;

// Endless loop
while(TRUE){
    pollStatusRegisters();
    delay(LOOP_DELAY);
};

为了进行测试、我将一个 Audio Precision APx555用作输入信号发生器和 TDM 接收器。 我的待测器件充当 TDM 从器件、而 AP 设为主器件。

发生器设置为1kHz 正弦波调节电平、直至达到0dBFS  (~1.93VRMS)

遗憾的是、当使用默认设置启用 DRE 时、波形上会出现一些失真。  

禁用 THD 可消除这些失真、测得 DRE+N 为-92.18dB

我已经通读了 DRE 应用手册(SBAA400A–2019年9月–2023年12月修订)、找不到任何说明可能导致此问题的原因的地方。

采样率设置为96kHz

对我可能做错了什么有任何想法? 提前感谢!

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    您是否摆弄过试图降低它的最大增益设置?

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    我已经尝试在对信号质量没有影响的情况下调整 DRE 的增益设置。 根据我对 DRE 功能的理解、在我测试的信号电平上不应使用该功能。 随着信号电平降低、DRE 将开始增加增益、并应进行调整以防止在需要放大的预期低信号电平发生削波。

    在1.93VRMS 下、DRE 应分离而不会影响信号质量?

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    您是否在 DSP_CFG1寄存器中启用了 DRE?

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    嘿、Sanjay、谢谢回复

    复位时 DRE 设置为默认选项、我还检查了寄存器并确保选择了 DRE

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    我成功地证明了失真取决于采样率。 在仍启用 DRE 的情况下将采样率从96kHz 降低到48kHz、结果很有希望。 查看原帖中所述 DRE 应用手册的表2-12、我现在正在测试的单个通道应支持96kHz 的采样率。

    我是否不仅通过上述设置启用了一个通道?

    我也无法看到 DRE 功能被触发、我已将输入电平降低到-65、而没有应用明显增益

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    我明天会回复。

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    您是否曾尝试在开启和关闭 DRE 的情况下测量 SNR?

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    感谢您的回复! 我成功解决了运行 DRE 时失真的问题。

    通过 IN_CH_EN 寄存器说明、默认情况下启用通道1-4

    我禁用了通道2-4、并能够在192kHz 的采样率下实现良好的信号质量

    我错过了该寄存器、因为我认为使能串行输出就是使能通道本身。