[参考译文] PCM5102：PCM5102与 UDA1334

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请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

器件型号：PCM5102

工具与软件：

大家好、我是一名应用工程师、在已经存在的基于 FPGA 的项目中、我需要一些帮助来选择一个 DAC、以代替已投入生产的 NXP UDA1334。

NXP UDA1334是一款硬件控制型 DAC、具有内部 PLL、可用于24位96KHz 下的3线左对齐数字音频数据格式接口、并由6.144MHz 的 BCK 比特率驱动

我无法更改已写入器件的主 FPGA 组件中的协议。

我已在您的 PCM5102 DAC 中实施了该方案、根据数据表、该方案应该能够像 UDA1334一样工作、但没有任何成功。

在纸上,他们看起来几乎相同(除了反向静音逻辑),但有些东西是缺失的,因为我无法使它工作。

如果有任何帮助、将不胜感激。

0 admin 4 个月前

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尊敬的 Roberto：

我假设你的原理图是正确的,基于这个假设, 我有以下评论。

b/w fs 和 bck 之间的关系基于以下内容：

BCK=# of Ch. * Ch depth * Fs

因此对于 fs=96kHz , 2通道 24位, 我计算出 bck 必须是 4.608MHz . 这与你的 bck 不同。 a bck= 6.144MHz 设置为32位数据、但如果发送24位数据、它将不起作用。

就像 SCK (MCK)一样、它必须符合表3。音频相关时钟的系统主时钟输入 (SCK 是 FS 的固定倍数)。

即使所有 CLK 都符合上述要求、也需要检查输入数据格式、例如图15。 I 2S 音频数据格式显示了 I2S 格式的 CLKS 和 DIN 的正确边沿。

如果在进行上述修正和修改后仍有问题、请告诉我。

此致、

Arash

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