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https://e2e.ti.com/support/audio-group/audio/f/audio-forum/1483619/pcm5102a-the-pcm5102a-outputs-nothing
工具与软件：
LRCK= 8kHz
bck=8kHz*32bit*2=512kHz
SCK= 1MHz
电源正常。
但我们在 OUTL 处什么也不测量。
随附的示意图为原理图。 请帮助分析在 OUTL 未测量的可能原因。
谢谢。
e2e.ti.com/.../3480.audio_5F00_pcm5102a.pdf
您好！
除了有关串联电阻器(22欧姆至100欧姆)的注释外、我看不到任何 原理图问题、但原理图中没有电阻器。
这是一个非常简单的器件、最重要的是您可能有一个简单的错误。 对于调试、请验证以下测试/检查：
验证 IC 的引脚上的所有电源电压是否正确
2V 负电压非常关键、请确保 VNEG 引脚上的电压为-3.3V。 如果 VREG 有任何问题、请检查与电荷泵引脚相关的电容器 (以及它们的 极性-如果适用)
3-格式(=low) 设置为 I2S、验证 发送给 DAC 的内容 是否确实是 I2S --如果是 RJ、LJ 等、 DAC 将不会像预期的 I2S 那样工作
4- XMST 被正确拉至高电平、所以它不被静音、然而在引脚上对其进行验证
5- 表10。 显示了给定 Fs 的正确系统主时钟、 请 根据表使用确切的时钟。
如果以上所有内容都已验证、但仍然 没有输出、 请重新打开此帖子并包含 所有 I2S 信号的屏幕截图、以便我们可以查看边沿相对于彼此的相对位置。
此致、
Arash
你好 Arash、
当我们不再为 PCM5102A 提供 SCK 时、OUTL 可以输出信号。
您能帮助解释为什么需要 SCK 吗？
有几件事要看。 首先、SCK 必须在数据表中提到的规格范围内、其次是 LRCK 和系统时钟的同步。 如果 LRCK 与系统时钟之间的关系变化超过±5 SCK、则内部操作(使用片上振荡器)会在一个采样周期内初始化、并强制模拟输出为双极零点电平、直到 LRCK 与系统时钟之间的重新同步完成、并且只要 LRCK 和系统时钟的同步未实现、就不会有输出。 然而、如果您移除 SCK、 器件启动时会预期一个外部 SCK 输入、但是如果 BCK 和 LRCK 在 SCK 保持接地电平16个连续 LRCK 周期的同时正确启动、那么内部 PLL 会启动、自动从 BCK 基准生成内部 SCK。
综上所述、 LRCK 和系统时钟的同步可能存在问题、移除后、PLL 会接管并在内部生成、一切正常工作。 因此、您的最佳选择是 使用 您在工作台上验证的3线选项(无外部 SCK)、它使用3线选项。
