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[参考译文] TMS320F28065:ADC 最大时钟频率

Guru**** 2502075 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/995418/tms320f28065-adc-max-clock-frequency

器件型号:TMS320F28065

团队、

数据表 SPRS698I 的表7.13.1.1显示最大 ADC 时钟频率为45MHz。

我假设、即使 TRM 没有指定最大值、并且建议可以实现高频率、数据表也会为我们为 F2806x 指定的最大 ADC clk 频率提供 initdefve 应答。 必须在数据表中指定的限值内使用该器件。

但是、请尝试更详细地了解限制最大 ADC 时钟的内容以及会产生什么后果:

-限制最大频率的因素是什么?
-如果我们使用的频率高于指定的最大值,会产生什么效果?
-如果我们使用永久高于指定最大值的频率,会产生什么效果? 它是否会影响转换的精度? 还是 ADC 无法正常工作?

我检查了第3代器件、似乎我们为几乎所有器件指定的最大值都是50MHz。

提前感谢!

A.

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    AnBer、您好!

    最大频率为45MHz、主要受 ADC 时钟分频器(SYSCLK 的/2或/4)限制、该器件的 SYSCLK 为90MHz、因此90MHz/2 = 45MHz。

    我们不会对超过数据表提供的最大频率的器件进行分类。 如果 ADC 频率超出数据表限制、则我们无法保证数据表中的其他 ADC 规格都能得到满足。

    此致、

    Marlyn