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https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/1210682/tms320f280025c-what-is-the-and-gate-transfer-delay-of-the-clb-module
尊敬的 Champs：
我们是否有任何有关 CLB 模块与门传输延迟的数据？ 它可以低于10ns 吗？ 谢谢！
此致、
朱莉娅
Julia、您好！
CLB 是一个可配置逻辑块、它使用 查找表来实现组合逻辑。 没有实际与门、LUT 会 为每个输入组合存储预定义的输出列表。
Omer Amir
