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[参考译文] TMS320F28235:XCLKIN 的时钟抖动

Guru**** 2386620 points
Other Parts Discussed in Thread: TMS320F28235
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/c2000-microcontrollers-group/c2000/f/c2000-microcontrollers-forum/1467017/tms320f28235-clock-jitter-for-xclkin

器件型号:TMS320F28235

工具与软件:

您好!

我的客户正在使用 TMS320F28235设计其原型。
然后他们想检查以下输入时钟规格是否没有问题、因为它比之前使用的规格略差。
对于 XCLKIN 输入、此抖动规格是否可接受?

周期抖动(峰峰值):344.1ps
RMS 抖动(1 Σ):
31.2ps
随机抖动(RJ):
66.9ps

此致、
OBA

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    尊敬的 Oba:

    频率和抖动容限等参数由您的应用(例如 ePWM 或 ADC 样本允许)决定、而不是由振荡器决定。 换句话说、您需要确定应用程序可容忍的容差和抖动量。 这不会影响振荡器本身。

    此致!

    Matt

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    Matt、您好!

    感谢您的答复。
    它是否也会影响 PLL 稳定性?

    此致、
    Obata Satoshi

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    尊敬的 Oba:  

    是的、您回答正确。 PLL 的抖动与使用的外部晶体的抖动相同。 因此 、您必须确定您的应用是否可以容忍将从输入时钟源通过 PLL 传播的抖动。  

    此致!

    Matt  

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    Matt、您好!

    感谢您的答复。
    我关心的仅仅是 PLL 的稳定性、这意味着如果它稳定地保持"锁定"状态、则 PLL 输出不会出现抖动。
    这是没有问题的,不是吗?

    此致
    Obata Satoshi

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    您好!

    否、我不明白这会是什么问题。

    此致!

    Matt

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    我 假设这个问题已经解决、并关闭该主题、因为它已经持续了几周、没有 回复。 如果情况并非如此、请打开新主题帖。