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[参考译文] CDCEL925:输出阻抗问题

Guru**** 2379650 points
Other Parts Discussed in Thread: LMK1C1102, SN74AXC1T45, CDCE925
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1510806/cdcel925-question-on-output-impedance

部件号:CDCEL925
Thread 中讨论的其他器件:LMK1C1102SN74AXC1T45CDCE925

工具/软件:

您好、

我在设计中使用的是这种 PLL。 我对应该使用的串联输出阻抗有疑问。 输出正在驱动一堆 SN74AUC 器件、LMK1C1102缓冲器和 SN74AXC1T45收发器。

我只是将它们连接起来、作为指向 PCB 上的点对点。 但是、PCB 布线上的信号保真度对于我的应用非常重要、因为这是一种测试和测量应用。

谢谢、

Prasoon

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    Prasoon、

    对于50欧姆电路板环境、CDCE925输出驱动器之后应放置一个18欧姆串联电阻器、以实现出色的阻抗匹配:

    谢谢、

    Kadeem

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    尊敬的 Kadeem:

    谢谢。 是的、现在我也能在数据表中看到。 很抱歉打扰了。 EVM 原理图在输出端显示22 Ω。

    Prasoon