This thread has been locked.

If you have a related question, please click the "Ask a related question" button in the top right corner. The newly created question will be automatically linked to this question.

[参考译文] LMK1D2102:引脚连接问题

Guru**** 2378650 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1514604/lmk1d2102-pin-connection-questions

器件型号:LMK1D2102

工具/软件:

您好:  

1)我会有一个从 SMA 连接器连接到引脚 IN0+的 CMOS 时钟输入信号,我应该浮动引脚 IN0-吗?

2)我只使用 OUT0 LVDS 输出、其他3个输出未使用、是否应该将 EN 引脚悬空?

谢谢你

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Hien、  

    1.遵循下面的拓扑。 如果使用 SE 输入-未使用的差分对内必须偏置到 VDD /2。  

    2.没关系。  

    不过、在这种情况下、将启用所有输出。  
    如果设置为"1"、则仅启用组1输出。  

    未使用的输出可以保持悬空或进行端接。  
     \

    此致、  

    Vicente