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[参考译文] LMK04610:旁路 PLL1 的时钟输出配置

Guru**** 2502205 points
Other Parts Discussed in Thread: LMK04610, LMK04616

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1545174/lmk04610-clock-output-configuration-with-pll1-bypassed

器件型号:LMK04610
Thread 中讨论的其他器件: LMK04616

工具/软件:

您好的团队、

我将在一个新项目中使用时钟分配器 LMK04610。

下图中有我为从 LVPECL 100MHz 振荡器到 LMK04610 的基准时钟分配而编写的电气原理图:

特别是、LMK04610 必须在单 PLL 模式下工作 (PLL1 旁路、无外部 VCXO):

从 100MHz LVPECL 输入、对于 CLKOUT10、CLKOUT8、CLKOUT7 、CLKOUT6、 CLKOUT5 和 CLKOUT1、输出为 400MHz。 CLKOUT2、 CLKOUT4 和 CLKOUT9 位于 1.5625MHz。

我通过相对评估板尝试了此配置、它可以正常工作。

附上我从 TICS Pro 下载的配置文件。

当我尝试将该文件上传到电路板时、 LMK04610 不起作用(不生成任何频率)。  

为什么它不起作用?


配置文件中是否有任何错误?  

 寄存器的写入顺序是否正确?

提前感谢您。

此致、

Matteo Ricci

e2e.ti.com/.../ref_5F00_clk_5F00_100M_5F00_PLL1_5F00_bypass_5F00_OUT_5F00_VCO_5F00_1200MHz user_5F00_OUT_5F00_SYSREF_5F00_SYSREF_5F00_00_00_5F00_ 400MHz 1.5625MHz

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    尊敬的 Matteo:

    我将能够 在星期一的实验室中对此进行测试。

    谢谢、

    Michael

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    您好、Michael:

    您有一些更新吗?

    谢谢您、

    Matteo

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    尊敬的 Matteo:

    我尝试使用您的配置、但也无法看到输出。

    我构建了一个具有您特定输出要求的配置、通过 CLKin0 获取单端输入。  

    我必须提供几个注意事项:

    1) 时钟树不可行。 有 2 个输出组无法输出多个频率 — 每组有一个分频器。 例如、CLKout0 和 1 有一个分频器、2 和 3、4 和 5、6 和 7 等 您无法从 CLKout8 输出 400MHz、也无法从 CLKout9 输出 1.5625MHz。 您必须相应地重新排列输出。

    2) 我的配置未完全完成。 我只是确保可以在示波器上看到您所需的输出。 此外、使用 TICS Pro 时、必须按下 Generic controls 页面上的“Device Start“按钮以启动器件。

    谢谢、

    Michael

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    您好、Michael:

    使用连接的寄存器并在 EVB 上按下器件启动后、我测量了 CLKOUT8 上的 400MHz 和 CLKOUT9 上的 1.5625MHz:

    我不明白为什么会看到相同的 输出信号。

    此外、这是我的 LMK 输出配置:

    因此、具有同一分频器的输出只有 3 和 4 以及 7 和 8。

    等待再次听到您的声音、

    Matteo Ricci

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    尊敬的 Matteo:

    我很抱歉,因为我没有向您发送我正在工作的配置文件,也没有使用相应的器件进行测试 — 我是在 LMK04616 上试用您的器件、它使用相同的内核、但输出数量不同、从而导致某些输出没有输出。 我重新尝试使用 TICS Pro 加载您的配置、并能够加载该配置和查看适当的输出频率、因此我认为您的问题出在您的编程序列中。

    您是否遵循了第 9.5.1 节中推荐的编程序列以及数据表第 9.3.9 节中建议的上电序列?  

    谢谢、

    Michael