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[参考译文] LMX2820EVM:通过与分配器时钟 LMX1204 生成同步信号来使多个 LMX2820 器件实现相位同步

Guru**** 2666105 points

Other Parts Discussed in Thread: LMX2820EVM, LMX1204EVM, LMX1204, LMX2820

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1594017/lmx2820evm-phase-synchronize-multiple-lmx2820-devices-by-generating-the-sync-signal-with-the-distributor-clock-lmx1204

器件型号: LMX2820EVM
主题中讨论的其他器件: LMX1204EVMLMX1204LMX2820

您好、

我正在尝试同步两个 PLL LMX2820EVM、如下图所示:

image.png

  • 工作频率范围 同步类别 2
  • 设计思路是使用 LMX1204EVM 的 SYSREF 输出 用作 PLL 的同步信号。 SYNC/SYSREF 输出将在内部生成到 LMX1204EVM。
  • PLL 同步后、 LMX1204 生成的同步信号将编程为的 SYSREF 输入(可能会更改频率)  PLL2820EVM 、然后将在中继器模式下使用。

我想知道这种架构是否可行、主要挑战是什么、以及应如何配置 PSYNC 引脚 (和相关电阻)使其正常工作。

提前感谢您的支持。

此致、
Ferdinando

 

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    尊敬的 Ferdinado:

    由于您有射频时钟缓冲器、因此可以将其用于从单个合成器扇出射频时钟、无需使用两个合成器。

    如果要坚持使用架构、只需使用逻辑器件为合成器生成同步脉冲。 这是可以实现的、因为 SYNC 脉冲的时序对于 Cat.2 同步不重要。

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    尊敬的 Noel:
    感谢您的答复。

    您说的是什么 “逻辑器件“ 您指的是 LMX1204 时钟分配器 还是另一个组件?
    遗憾的是、我无法修改我之前向您展示的架构、无法添加器件或更改所使用的通道数。

    我的目标是使用 两个 SYSREF 输出 从时钟分配器传输到 同步两个 PLL 。 您认为这是可行的吗?

    我也注意到了 LMX1204 的 SYSREF 输出使用 CML 电平 、同时在上 LMX2820EVM GUI PSYNC 输入 可以配置为 CMOS 或 LVDS
    您能建议如何正确调整这些标准之间的信号吗?

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    尊敬的 Ferdinando:

    逻辑器件指 MCU 或 FPGA。  

    您可以使用来自 MCU 的 GPIO 向两个 LMX2820 提供同步脉冲。  

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    尊敬的 Noel:
    我明白了、谢谢。