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[参考译文] LMX2694-LMX2694 EP：10MHz 设计的滤波器设计、相位噪声和波特图

admin
Guru**** 2689775 points

Other Parts Discussed in Thread: LMX2694-SEP, LMX2571

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1595923/lmx2694-ep-filter-design-phase-noise-and-bode-plot-for-10mhz-design

器件型号： LMX2694-LMX2694-LMX2694-LMX26146- EP
主题中讨论的其他器件： OPA211-OPA211 EP、 LMX2571-LMX2594-SEP EP

您好：

我目前正在设计一个 PLL、用于分别将 10MHz 基准上变频为 5000MHz 以及 10000MHz ADC 和 DAC 基准时钟。 我在 10000MHz 上附上了一张 PLL 设计图像。 但我应该注意的是、我确实打算使用 A 型有源滤波器、但我想使用 EP、它具有 1.1nV/√Hz 的出色噪声特性。

image.png

我认为我已经将环路带宽、相位裕度和相位噪声明白到我的设计可接受的水平、但我不确定稳定性波特图。 请参阅以下内容。

image.png

我知道相位裕度设计可能过大、但是、我担心相位裕度在超过 2MHz 偏移后会急剧滚降。 有人能为我所描述的应用提供一些关于合适波特图设计的指导、以及关于改进整体设计的一般建议（如果适用）吗？

谢谢您、

Joseph Blank

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    TI__Guru**** 2689775 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Joseph：

    PM 图的形状根本不重要、它或多或少只是方程的结果。 例如、当 PM 为 50 度时、滚降会更剧烈。

    看起来您尝试使用高 LBW 和 PM 四阶滤波器优化抖动、但是、仿真会返回一些非常小的元件值、因此实际上是二阶滤波器。 实际上、二阶滤波器设计可以得到相同的结果。

    LMX2694 无法切换电荷泵的极性、要使用有源环路滤波器、我们需要两个采用反相配置的运算放大器或一个采用同相配置的运算放大器。  

    或者、我们可以使用无源滤波器来获得稍高的抖动性能。

    如果 10MHz 时钟是正弦波、我非常确定实际带内相位噪声会高于仿真值。 这是 10MHz 时钟的压摆率较差造成的。 方波时钟可解决此问题、但输入倍频器会在 CPout 上产生干扰、FPD 杂散会更高。

    如果您的目标是获得尽可能低的抖动、建议使用更高的输入时钟频率。  

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    TI__Guru**** 2689775 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    尊敬的 Noel：

    非常感谢您的详细答复。 为了提供一些额外的背景信息、我使用 10MHz 方波 LVCMOS 时钟作为输入。  我认为、最好的做法是将我的 10MHz 方波 LVCMOS 时钟输入上变频到 100MHz EP、然后将其输入到 LMX2694-LVCMOS 中。 您能否为此流程推荐芯片？ 我认为 LMX2571-LMX2571 EP 是一个不错的选择。  

    频率合成设计将为：

    10MHz LVCMOS 时钟源--> LMX2571-LVCMOS [从 10MHz 向上转换到 100MHz CMOS]--> LMX2694-LVCMOS [从 100MHz 向上转换到 5000MHz 和 EP EP 10000MHz ]

    这一过程是否有意义？ 请随时提出任何建议或建议。 我针对 LMX2571-SEP 和 LMX2694-SEP 运行了仿真。

    LMX2571 - EP 仿真：

    LMX2694-LMX26SIM EP：

    最后、我可能已经注意到、我提到了 LMX2694-PLLatinum EP、但 PLLatinum Sim 不允许选择“-PLL"<xmt-block1>“ EP、而只允许选择“-SEP"。“。 我假设这可以接受、即使我不打算使用航天级版本？ 如果是、那么所有元件都是如此吗？

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    TI__Guru**** 2689775 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    尊敬的 Noel：

    抱歉、E2E TI 论坛速度非常慢、 在尝试上传多张照片时、网站经常会崩溃、因此请查看下面的 LMX2694-SIM EP。

    再次感谢您的支持！ 请参阅我的后续答复正文中的上一条消息。

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    TI__Guru**** 2689775 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Joseph：

    没错、 这是 在馈送到射频合成器之前使用 PLL 将 10MHz 上变频为 100MHz 的典型方法。

    为了向射频合成器提供低抖动 100MHz 时钟源、PLL 应与 VCXO 配合使用。

    因此架构如下：

    10MHz（正弦波或方波）-> PLL + 100MHz VCXO ->射频合成器。

    PLL 的环路带宽非常窄、通常为 10Hz 或更小、因此输出相位噪声基本上等于 VCXO 的相位噪声。