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[参考译文] LMX1205：LMX1205 编程相关查询、差分输入电压摆幅

admin
Guru**** 2766465 points

Other Parts Discussed in Thread: LMX1205

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1592439/lmx1205-lmx1205-programming-related-queries-differential-input-voltage-swing

器件型号： LMX1205

您好、  

目前、我们使用 LMX1205 作为时钟缓冲器。 对此有一些疑问、  

1) 单端输入的输入灵敏度为 0dBm 至 10dBm、差分输入的输入电压摆幅是多少？  

2) LMX1205 是否强制要求 CLK_P 和 CLK_N 电压偏置网络？

3) 我们正在尝试在全部 4 个通道中生成 SYSREF 信号、而不生成输出时钟？ 这是否会在对器件进行编程时产生任何问题？  

 我们面临着一些问题、例如通过器件中加载的 TICS Pro 生成的寄存器文件、我们能够回读寄存器。 但不会生成输出 LOGICLK 和 SYSREF 信号。 问题可能是什么？

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    TI__Guru**** 2766465 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    我刚刚注意到您发表了两篇文章、并在这里进行了编程。 我作了一些答复。

     LMX1205：CLKIN_P 和 CLKIN_N 差分输入电压摆幅相关 

    几个想法：

    • 复位位设置为 1；每当您写入 R0 时（例如，在“写入所有寄存器“操作结束时）、所有寄存器状态都会复位。 在正常运行期间、该位应设置为 0。 TICS Pro 包括对 R0 的初始写入、这会清除器件。
    • 设置 SYSREF_DLY_BYP 位。 我不确定您是否要在发生器模式下执行该操作、因为它绕过延迟发生器、并且无论内部路由的传播延迟允许、所有 SYSREF 都从输出中发出。

    加载配置时、清除 RESET 位、清除 SYSREF_DLY_BYP、按 Ctrl-L 加载所有寄存器、我发现器件会产生 LOGICLK 和连续 SYSREF 输出。

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    TI__Guru**** 2766465 points
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    尊敬的 Derek：  

    感谢您的答复。 我将进行更正。  

    一些寄存器在数据表中未披露。 并提供了要写入的建议数据。  

    但在 TICS PRO 中、它可能会改变。 这是否会影响缓冲模式下的输出生成？  

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    TI__Guru**** 2766465 points
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    您好！

    您能否提供您观察到的差异？   

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    TI__Guru**** 2766465 points
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    关于偏置 2)： 数据表在 6.3.3 中指出：“根据器件内部架构、为了获得出色的器件性能、需要在引脚 CLKIN_P 和 CLKIN_N 之间进行失调电压。 要产生偏移、必须使用外部对 CLKIN_P 和 CLKIN_N 引脚进行偏置
    电阻器。 偏置网络电路应如下所示。 推荐的电阻值为 R2 = 9.5k、R3 =
    7.5k、使 R1 和 R4 不组装。“  

    这种偏见是否必要？

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    TI__Guru**** 2766465 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、直至：

    我认为这种偏置不是必需的。  

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    TI__Guru**** 2766465 points
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    谢谢 Noel。 我还在这些引脚上测得了 1.35V 偏置电压、这符合您的建议。