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[参考译文] LMK04714-Q1:PLL1 旁路

Guru**** 2952510 points

Other Parts Discussed in Thread: LMK04714-Q1

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1658589/lmk04714-q1-pll1-bypass

器件型号: LMK04714-Q1

尊敬的团队:  

我们有关于 LMK04714 的问题。
我们希望通过 CLKin0 (10MHz) 进行连接、并 仅使用 PLL2 (单个 PLL 用于 2500MHz)、因此在这一问题上缺乏清晰度。
 
根据  数据表第 22 页的图 8-1、CLKin0 似乎没有直接到达 PLL2 并在该处生成高频以供分配的选项。
 
根据 第 41 页的第 8.4.2 节的图 8-13 或 8-14、可以输入 CLKINx、其中未指定 x 不能为 0、因此似乎这确实是可能的。
 
我尝试在  没有 EVB 卡的 TICS PRO 中执行此操作、它似乎是可能的(附件是我在 SA 计算机上拍摄的屏幕截图)。
 
如果您能为我们澄清关于这一问题的正确答案、我将不胜感激。
  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    LMK04714-Q1 可通过 PLL2_RCLK_MUX 字段将 CLKin0(或 CLKin1 或 CLKin2)路由到 PLL2。 这是该器件的预期用例。 LMK04714-Q1 数据表中的图表不正确。 在不久的将来、我有一个修订版正在等待发布。