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[参考译文] LMK05028:相位锁定行为

Guru**** 2511985 points
Other Parts Discussed in Thread: LMK05028

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1079351/lmk05028-behavior-of-phase-lock

部件号:LMK05028

大家好,团队

在 PLL 中发现了意外行为。 您能否验证客户看到的行为是否正确?

1.当失去相位锁时, LMK05028似乎需要比预期的时间多。 (两个周期为10秒)看起来像 LMK05028只能执行相位锁定。 LMK05028是否能够锁定频率以更快锁定?

2.频率锁定是否有任何限制?

3.关于锁相,即使有很多时间,锁相似乎太慢了。 LMK05028相位锁定在多个时段时是否能够更快,然后在90度内锁定速度是否可以?

此致,

Hideki

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    Hideki-san,

    由于 LMK05028支持多种配置,因此您的问题的答案取决于多种因素。

    • DPLL 参考输入参考频率,格式和占空比是多少?
    • 设备使用的配置是什么? (双环,三环等)
    • 是否有可供我们查看的配置的.TCS 文件? 这对我们确定 问题的根源来说是非常关键的。

    通常,获得相位锁定但不获得频率锁定表示 DPLL 验证参数存在问题,或者输入可能存在一些独特的问题,例如脉冲重叠或缺失,从而阻止频率锁定检测正确验证。 相位锁定也是参考输入频率和 DPLL 环路带宽的函数-较低的环路带宽将增加锁定时间,每秒的 TDC 比较(特别是对于极低频率的输入参考)更少将大大 增加锁定时间要求。  快锁功能最初使用更宽的环路带宽来居中相位误差,这可以加快锁定时间,但根据输入参考频率和 TDC 频率,它可能 不起作用。

    此致,

    德里克·佩恩

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    嗨,Hideki-san,

    这段时间没有听说过,假设问题已解决。

    立即关闭线程。 您可以随时再次打开或为进一步查询创建新线程。

    谢谢!

    此致,

    阿耶特·帕尔