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[参考译文] LMK0.4828万:时钟输出Vpp低,带LVPECL20输出格式

Guru**** 2554390 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/666882/lmk04828-clock-output-vpp-low-with-lvpecl20-output-format

部件号:LMK0.4828万
主题中讨论的其他部件: LMK0.4808万

您好:

我使用LMK0.4828万提供DAC采样时钟,外部VCO模式(1.728GHz原始时钟输入到CLKin1,并使DCLKOUT6输出1.728GHz时钟)。 未使用内部PLL)。

输出端口是DCLKOUT6,它被设置为LVPECL20的输出格式,输出P/N引脚被下拉至具有240欧姆电阻的GND,如下所示:

当使用差分探针测量DCLKOUT6的输出振幅时,结果Vpp大约为650mV,如下所示:

请注意:以上屏幕截图中的Vpp是使用差分探头测量的差分电压,而不是在两条差分信号线路之一上测量单端探头。

数据表显示,当输出格式设置为LVPECL20时,VOD为960mV,因此峰间电压差为2*960=1920mV。 (如数据表SNAS605AR所述:第27页-图9)。

因此,测得的650mV比所需的1920mV低得多,无法满足DAC采样时钟振幅的要求。

鉴于这种现象,我将 +和-线路的下拉电阻从240欧姆更改为50欧姆,然后输出Vpp增加到1180mV,但仍无法达到数据表额定1920mV,如下所示:

现在,您能找到问题所在吗?

谢谢!

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    尊敬的用户,星期一有人将查看此问题。感谢您的耐心,此致,Simon。
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    您好,

    输出电压随频率而变化。 有关详细信息,请参阅LMK0.4808万数据表部分6.7 图2和图3。
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    您好:

    我在LMK0.4828万数据表中找不到有关输出电压如何随频率变化的相应说明;只能在LMK0.4808万数据表中找到。

    即使LMK0.4828万的输出字符与LMK0.4808万相同,1.728GHz时钟输出的Vpp测量值也远远低于数据表图中的额定值。

    下图可在LMK0.4808万数据表中找到(请注意,我使用的芯片是LMK0.4828万而不是LMK0.4808万)

    那么,您能回答我,LMK0.4828万的输出字符是否与LMK0.4808万相同,以及如何提高输出Vpp的高度吗?

    非常感谢!

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    我实际使用的芯片是LMK0.4828万,而不是LMK0.4808万;此外,我需要知道如何将输出Vpp提高到额定值或接近额定值。
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    LMK0.4828万具有与LMK0.4808万类似的LVPECL驱动器功能,因此测量结果是合理的。 在1.728 GHz时,没有任何方法可以继续增加输出摆幅。
    接收器Vpp要求如何?
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    您好:  

    DAC要求采样时钟至少为1400mV Vpp。 考虑到数据表的相应说明,LMK0.4828万应满足该要求。

    那么,在我的设计和应用中,LMK0.4828万的寄存器配置或硬件设计缺陷是否存在任何问题?

    期待您的回答,谢谢!  

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    您好,

    我脑海中的几个想法:
    您的范围的带宽是多少?
    您的探头的电容是多少?
    是否可以尝试100pF而不是100nF交流耦合盖?
    您测量时钟是否接近DAC的输入?
    DAC的输入阻抗和电容是多少?
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    注意到的波形就像正弦波,我同意存在路径(板载或测试路径)带宽限制来造成振幅损失。
    理想的波形应该像方波,即使对于1.728 GHz来说很难。
    让我们将调试目标设置为Noel的图3 (VOD=0.8V,Vpp=1.6Vpp),它可以满足DAC的1400mVpp要求。