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[参考译文] LMK0.4832万：寄存器设置请查看。

admin
Guru**** 2577385 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1090084/lmk04832-register-setting-review

部件号：LMK0.4832万

尊敬的支持团队。
我有 一个注册设置问题。

我们正在原型板上评估LMK0.4832万。 。
我们在2560MHz的频率范围内更改了VCO0的设置。
当我在实际机器上检查时，预期值为80MHz，但测量值为83.453MHz。
我想了解一下为什么它不能达到80MHz。
我将附上注册设置文件。
e2e.ti.com/.../LMK0.4832万_5F00_TED_5F00_0401_5F00_00.tcs</s>0401

此致，
Hiroaki Yuyama

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    TI__Guru**** 2577385 points
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    Hiroaki-san，您好！

    可能是由于PLL未锁定和缺省频率输出的原因。  PLL2_N_CAL值应与PLL2_N值相同，因为设备在 频率校准期间使用PLL2_N_CAL值。

    您能否检查PLL1和PLL2是否锁定？  

    您可以尝试更新.TCS文件并查看性能。

    e2e.ti.com/.../LMK0.4832万_5F00_TED_5F00_0401_5F00_00_5F00_updated.tcs</s>0401

    谢谢！

    此致，

    Ajeet Pal

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    TI__Guru**** 2577385 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好，Ajeet-San，

    非常感谢您的建议和更新注册设置。
    我更新寄存器设置以检查PLL1和PLL2是否已锁定。
    我将再次告诉您更新的结果。

    此致，
    Hiroaki Yuyama

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    TI__Guru**** 2577385 points
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    您好，Ajeet-San。

    非常感谢您的建议和更新注册设置。
    我将其更改为您的寄存器设置，并将外部CLK输入从DC更改为AC输入，它工作正常！
    我们通常会锁定PLL并消除频分设置的偏差。
    原因是DC CLK输入的低电平和高电平超出数据表的规格。

    此致，
    Hiroaki Yuyama