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[参考译文] CDCM7005-SP:相位校准和复位后延迟

Guru**** 1791630 points
Other Parts Discussed in Thread: CDCM7005-SP
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1095914/cdcm7005-sp-phase-alignment-and-delay-after-reset

部件号:CDCM7005-SP

您好,

我的客户希望按以下方式使用CDCM7005-SP。

- VCXO_In --> PDIV=/2 --> Y0A (LVPECL)
- VCXO_In --> PDIV=/4--> Y1A (LVPECL)
- VCXO_In --> PDIV=/8 --> Y2A (LVPECL)
- VCXO_In --> PDIV=/16--> Y3A (LVPECL)

关于这种用法,他们有一些问题,如下所示。

问题1:
Y0A,Y1A,Y2A和Y3A上升边缘相位在16次VCXO_In循环后是否对齐,如下所示?
或者需要重置以对齐它们,如下所示?

问题2:
在数据表的图11中,LVPECL的最大tpd (lh),最大tpd (HL),最小tpd (lh)和最小tpd (HL)分别有多少?

问题3:
从取消RESET_断言到yna输出第一上升边缘的延迟有多大?

此致,

K.Hirano

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    CTS团队,

    我的客户正在等待您的团队反馈。
    能否请CTS团队的人员回答?

    此致,

    K.Hirano

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    平野山

    问题1: 对 多路复用进行编程以路由分离的输出后,P计数器可能应通过切换RESET_ Pin来重置。 我不确定在修改分隔符值时,默认情况下是否会自动出现这种情况。

    问题2:我们没有 关于这些值的最小值或最大值的任何表征数据。 这些参数在生产过程中也不会进行测试,因此我们没有生产数据来帮助建议限制。 我对这个问题没有很好的答案。

    问题3: RESET_函数与VCXO是异步的,因此从重置到yna输出第一上升沿不保证有延迟。 我看到重置边缘切换和时钟断言或断言之间的典型延迟约90µs。

    此致,

    Derek Payne

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    Derek,

    感谢您的回答。

    此致,

    K.Hirano