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[参考译文] LMK1D1208:占空比

Guru**** 2387830 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1105371/lmk1d1208-duty-cycle

器件型号:LMK1D1208

您好的团队,

最近、我正在与客户合作以鉴定 lmk1d1024/8。  
1) 1)客户希望使用其来自 FPGA 的 IN1倍 LVDS 信号。 输入 f 为200kHz、占空比为0.2%。 我不确定是否正确。 我在数据表中没有看到任何相关的说明。

2) 2)如果可行、对 Ton 有任何限制?

谢谢、

BR、

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    您好、Hugh、

    这不是问题。 200kHz 的0.2%会产生10ns 脉冲。

    可以使用最大允许频率计算脉冲的最小 Ton (或非常高占空比应用的最小 Toff)。 对于单端输入、它是250MHz 或4ns。 对于差分信号、它是2GHz 或500ps。

    此致、

    Julian

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    尊敬的 Julian:

    感谢您的支持。

    我对"ODC"有一点困惑。 如果输入占空比为0.2%,输出占空比是否在[0.018%、0.022%]范围内?   

    BR、

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    您好、Hugh、

    输出占空比将随频率、温度、工艺和电源电压的变化而有所变化。

    尽管我们没有以0.2%的占空比对此进行描述、但10%的变化应该是正确的。 在给定的频率和电源电压下、变化实际上应小于10%。

    此致、

    Julian