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[参考译文] LMK03000:PLL 锁定不稳定、N 分频器输出略高

Guru**** 2507815 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1044988/lmk03000-pll-lock-is-unstable-with-n-divider-output-is-slightly-high

器件型号:LMK03000

您好!

EVM 在附加的文件设置下工作正常、但客户电路板的 PLL 锁定不稳定、输出频率略高(所有5个原型 PCB 都相同)。

e2e.ti.com/.../LMK03000_2D8A9A5BAD30E330D730C130E330_.xlsx

我监控了多路复用器的 R 和 N 分频器/2输出、以调查原因。
R divider /2输出正常、但 N divider /2具有稍高的频率(由于 N-div = 3.84MHz、MUX out 最初为1.92MHz、但输出为2.08MHz)。

我认为 VCO 的输入电平很低、要求通过寄存器设置提高 CP 电流、但它已经是最大值、因此我无法解决。

电源是一个外部稳压电源(与 EVM 相同的电源)。

出什么问题了? 您是否有任何改进建议?
R 分频器正常、因此至少我认为中的 REF 正常。
这是否是 PCB 布局的问题?

此致、

Hiroshi

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    Hiroshi 您好!

    如果 N 分频器输出略高于预期、则 VCO 以更高的频率运行。 因此器件未锁定。

    这可能有多种原因:

    1、OSCin_FREQ 寄存器设置不正确、因此 VCO 校准错误。 -请检查

    2.输入噪音太大-请检查

    3.环路滤波器/CP 设置不是最佳-设置似乎正常。

    4.原理图/布局问题-请分享

    5.编程顺序不正确。 -请检查

    此致、

    Julian

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    大家好、Julian-San、

    我与客户确认了。
    1 我在输入频率= 3.84MHz 时尝试了"OSCin_FREQ = 3MHz、4MHz"、但状态没有变化。
    2 我研究了外部信号发生器和电源、但似乎没有问题。 这些与 EVM 相同。
    4 我得到了电路图和 PCB 布局。

    e2e.ti.com/.../_DE56EF8DF356_.pdf

    e2e.ti.com/.../_FA577F67F356_.pdf

    顶层是 P6、底层是 P11。

    5 我从 FPGA 中删除了写行并从 USB ANY2中写入、但没有变化。

    我正在查看此资料、但我只是想告知您客户 的回应。

    此致、

    Hiroshi

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    Hiroshi-San、

    我看到引脚32 (CPOUT)上的组件标有"NI"。 这是否意味着这些器件未组装?

    这些组件对于确保环路稳定至关重要。  

    此致、

    Julian

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    尊敬的 Julian-San:

    我已确认。

    C60 (C1)0.15nF、  C61 (C2)8.2nF、  R32 (R2)2.2kΩ

    C62未执行。

    此环路滤波器是否存在问题?

    为了检查 VCO 输出、我打开了 EN_Fout 并监控了 Fout、但它保持在 GND 电平。 除非 PLL 被锁定、否则它不会输出吗?

    此致、

    Hiroshi

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    Hiroshi-San、

    您是否尝试对器件进行 ABA 换用? 将客户 PCB 单元更改为将 EVM 和 EVM 单元工作到客户 PCB?

    当您说"EVM 上的工作原理"时、您是否还具有客户电路板上的环路滤波器值?

    我在客户原理图上也没有看到 OSCin 端口的交流耦合。 您能否确认已实现此功能?

    此致、

    Julian

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    Julian-san、

    感谢您的支持。
    我要求客户调查以前的板工作正常、新的板不工作之间的区别。

    我使这个线程"已解决"。