[参考译文] CDCI6214：LVCMOS 抖动和输出通道

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/1136571/cdci6214-lvcmos-jitter-and-output-channels

器件型号：CDCI6214
主题中讨论的其他器件： CDCE6214

您好！

我希望使用 CDCI6214来生成四个2MHz LVCMOS 时钟。我想在 TICS 软件中将 out2/3输出到 CMOSP 和 P+/N+、那么引脚13、14、17、18将生成4个2MHz LVCMOS 时钟、对吗？

2.我使用 CDCI6214是因为我有一个时钟生成 LVPECL 时钟、所以我希望使用同一个部件。但数据表中没有 LVCMOS 输出抖动信息。您知道 LVCMOS 信号在12kHz 至20MHz 范围内的 RMS 抖动吗？我看到 CDCE6214有一些信息显示整数模式下的最大 LVCMOS 抖动为1.5ps。我的设计的最大抖动为1.5ps。但我不想使用 CDCE6214、因为它无法替代现有的 CDCI6214来生成 LVPECL 信号。

3.如果 CDCI6214的 LVCOMS 低抖动不能超过1.5ps。我可以使用哪些缓冲器来生成具有低抖动的4通道2MHz LVCMOS？我还可以使用它来生成 LVPECL 时钟。因此、我希望 CDCI6214的价格能够接近。

此致、

舒

3 年多前

0 admin 3 年多前

TI__Guru**** 2587345 points

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您好、Shu、

1. 正确。

通常为常见输出频率提供 RMS 抖动、鉴于您的输出频率为2MHz、我们不会出现这种情况。列出的最大 LVCMOS RMS 抖动1.5ps 假设您的输出频率大于100MHz。考虑到您的2MHz 输出频率较低、RMS 抖动应低于1.5ps、因此这不是问题。

此致、

维森特

0 admin 3 年多前

TI__Guru**** 2587345 points

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您好、Shu、
还有一件事。如果您仅从80MHz 输入输出2MHz 信号、您实际上可以绕过 PLL、只需使用输出分频器即可获得更好的抖动性能。

此致、

维森特

0 admin 3 年多前

TI__Guru**** 2587345 points

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你(们) Vicente。

1.5ps RMS 抖动来自 CDCE6214。您是否具有 CDCI6214的 LVCOMS 抖动特性？ I LONY 可以在数据表中看到 LVDS 和 HCSL 信号的抖动。

2.我需要将2MHz 与主80MHz 同步。那么、旁路 PLL 不能实现这一点、对吧？

此致、
舒

0 admin 3 年多前

TI__Guru**** 2587345 points

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您好、Shu、
我们没有该规范、但您的要求将得到满足。请注意、在数据表中、这些值是如何针对常见输出频率列出的。

2. 如果您需要同步、那么很遗憾、您不能绕过 PLL。

此致、

维森特

0 admin 3 年多前

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尊敬的 Vicente：

非常感谢。现在、我有信心在我的设计中使用 CDCI6214来生成具有1.5ps 更低抖动的2MHz LVCOMS 时钟。

此致、
舒

时钟和时序（参考译文帖）

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