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大家好、
是否有人可以验证用于 多个 RFSoC 同步的时钟方案
我是否能够在每个 RFSoC 上实现所有时钟输入的相位变化小于5度？
您好、Shekhar、
低于5度的6GHz 是... ~2.3ps。 我认为您无法通过 PVT 实现这一点。 您可以在 LMX2594中使用微调相位的功能来调节到该水平。
由于您不是通过 CLKin0对 SYSREF 进行重新计时、因此您需要向两个 LMK04832发送 SYNC 信号以同时请求 SYSREF、从而使每个 LMK同时 生成 SYSREF。
73、 Timothy
你(们)好
由于我将参考时钟提供为5MHz、且长度与所有 LMK 匹配、因此我希望所有 SCLKOUT 都处于同相状态。
那么、为每个 LMK 提供外部同步的需求是什么
我的设计中没有任何此类规定
请提供您的反馈
我的以下理解是否正确？
"
我们是否需要 RFSoC 的所有 SYSREF 同时在同一边缘发生？
如果是相同的边沿、而不是相同的时刻、则所有 SYSREF 不需要同时发生同步
如果是相同的边沿和相同的时刻、那么我们将需要同时从所有下游 LMK04828器件请求 SYSREF
[引用 USER="Shekhar Kulkarni"]我们是否需要 RFSoC 的所有 SYSREF 都在同一边缘同时发生？[/QUERPLET]
不用于 JESD204B 对齐。 仅当您添加此要求时。 JESD204B 确定性仅存在于 LMFC 内。 此外、您还必须跟踪计时情况。
因此在 SYSREF 频率下具有0延迟。 因此、如果您发送 SYSREF 并重置一个转换器的 LMFC。 然后在5分钟内发送 SYSREF 以重置另一个转换器。 从 JESD204B 的角度来看、第一个转换器在5分钟后发送第二个 SYSREF 的同时收到了 SYSREF。
您好、Timothy、
当配置数字延迟以对齐 SYSREF 和时钟输出时[有助于消除路由延迟或将 SYSREF 输出对齐到数据时钟上的有效窗口中心]，我们是否需要提供同步输入，以及在 LMK 的哪个引脚上？
如果是，它是否来自主 LMK 器件？
在对字段 SDCLKoutY_DDLY 进行调整时、无需同步。 如果您更改全局 SYSREF 数字延迟(SYSREF_DDLY)或器件时钟数字延迟(DCLKoutX_DDLY_CNTL/CNTH)、则需要提供同步。 -要进行同步以更新 DDLY，最简单的方法是提供软件同步。 您需要设置所有 SYNC_DIS = 0。 0x144 = 0x00。 然后将 SYSREF_MUX 设置为正常。 切换 SYNC_POL。 然后、您可以返回到之前的配置并再次设置0x144 = x0ff。 -请参阅数据表第9.3.2节。 - LMK04832 TICS Pro 配置文件将生成一个寄存器序列、以便在底部的频率规划器选项卡下进行编程... 这适用于 LMK04832。 不过、寄存器映射是类似的。 它可能适合您。 最后，请查看： www.youtube.com/watch
因此、假设我将执行"全局 SYSREF 数字延迟"、为了提供同步、我将只执行软件配置、而不使用任何外部主器件 LMK 来提供同步...
另一个问题是，如果器件 CLK 和 SYSREF 分别由不同的器件(即 LMX 和 LMK)生成，那么如果我们需要 根据 LMK 的 SYSREF 调整 LMX 输出的相位，该过程是什么？
通常、您无需调整全局 sysref 数字延迟。
如果您选择不使用外部主器件来提供同步、这是可以的。 但是、当向两个电路板请求 SYSREF 时。 这增加了每个 LMK04828中的 SYSREF 不会完全同时发生的可能性。 如上所述、JESD204B 不需要这一点、因为当它输出时、它将通过5MHz 时钟边沿之一确定。 如果您的应用确实需要在完全相同的时刻发生 SYSREF、 最好的选择是使用上游 LMK04828或 LMK04832生成 SYSREF 脉冲、并配置下游 LMK04828或 LMK04832将 CLKin0重新计时到 SYSREF 输出。 第二个最佳选择是使用公共 SYNC 引脚。
如果您选择使用 sysref DDLY 调整 LMX2594的相位输出、而不是 LMK SYSREF 的相位。
请注意、LMX2594支持通过 RFoutB 对 SYSREF 进行重新计时、我可能会建议这样做。
有关相位调整的信息、请参阅第29页上第7.3.11节"相位调整"下的 LMX2594数据表。 对 MASK_SEED 字进行编程。
