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[参考译文] LMK04616:LMK04616

Guru**** 2386610 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/996729/lmk04616-lmk04616

器件型号:LMK04616

你(们)好

我知道、温度会改变 ClkinX 到 ClkoutX 之间的延迟。

问: 如果我使用两个器件、是否可以说、随着温度的变化(两个器件的变化相同)、从 ClkinX 到 ClkoutX 的延迟 会发生变化并沿相同的方向移动?

谢谢

莫蒂

DSIT

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    您好、Moti、

    是的、这通常是正确的。  仅当包含 PLL1时、相位才可能不会跟随良好。

    73、
    Timothy

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    你好、Timothy

    感谢您的快速重播。

    在您的回答中、让我感到困扰的词语是"一般"。

    两个器件在同一温度下的延迟差异最大?

    TI 是否有关于此主题的规范? 我的意思是、如果 TI 承诺温度的延迟变化将始终保持相同的方向?

    谢谢

    莫蒂

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    您好、Moti、

    我说"一般"是因为我们没有关于两个器件在相同温度下的最大差异的具体规格。  但是、我们确实有一些数据、如 e2e 文章 https://e2e.ti.com/support/clock-and-timing/f/clock-timing-forum/987282/lmk04616-datasheet-parameters-confuse 中所示

    请注意、这是在缓冲模式下。

    您对哪些模式或模式感兴趣、以了解传播延迟?

    73、
    Timothy

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    你(们)好  

    当基准时钟被插入 OSCin 时、我只使用具有零延迟模式的 PLL2。

    我知道我的模式称为 ZDM。

    如果这是真的、我会感到困惑。 您添加的链接中写入的信息说明了器件之间在任何温度范围内的偏差在 ZDM 时约为30ps、在缓冲模式下约为700ps。 第一张图显示了 ZDM 的偏斜。 在该图中、我可以看到偏移为~500、它不是 ZDM 缓冲模式。 我预计在该模式下将达到30ps。

    也许我不明白什么是"缓冲模式"。 你可以帮帮我吗?

    谢谢

    莫蒂

    DSIT

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    您好、Moti、

    在缓冲模式下、CLKIN 上的输入时钟可绕过两个 PLL 直接路由到 CLKOUT。

    让我来回顾一下这些信息、并与您一起返回。

    73、
    Timothy

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    你(们)好  

    我希望您在缓冲模式和 ZDM 模式下检查两个器件之间的偏差问题。 
    我正在等待您的重播。

    感谢你的帮助
    莫蒂
    DSIT
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    您好、Moti、

    很抱歉耽误你的时间。

    是的、所以我查看了另一个帖子。  这表明、与输入直接缓冲到输出的模式相比、使用 ZDM 模式确实具有更一致的传播延迟变化。

    因此、为了最大程度地减小器件间差异、我建议使用 PLL2 ZDM 模式... 但是、我没有最坏情况规格。  但是、考虑到该数据中使用了不同的工艺角、并且仍然非常接近、对于处于相同温度的器件、对于处于相同温度的器件、预计器件的误差小于30ps 是合理的。  如果温度不同-您还必须考虑该变化。

    73、
    Timothy

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    你(们)好  

    我的理解是:

    在 ZDM 模式下、器件在相同温度下的偏斜将为~30ps。  

    2. TI 不承诺最大偏斜。

    奇怪的是、器件规格显示同一组件上的输出时钟之间的偏差为60P (典型值)。 组件之间的差异是否可能仅为30P?

    感谢您的重播

    莫蒂

    DSIT

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    您好、Moti、

    输出时钟之间的偏差。  上述数据仅适用于一个输出时钟(CLKout0)、并侧重于输入到输出传播延迟变化。  除此之外、我要添加输出到输出偏斜。

    73、
    Timothy

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    你(们)好  

    如果 TI 没有关于两个器件之间偏移的规格、如何设计一个具有两个并联运行的组件的电路?
    是否有 TI 可以承诺的数字?

    谢谢

    莫蒂

    DSIT