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[参考译文] LMK04832:LMK04832 Sysref 时钟问题

Guru**** 2535750 points
Other Parts Discussed in Thread: LMK04828, LMK04821, LMK04832

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/882012/lmk04832-lmk04832-sysref-clock-problem

器件型号:LMK04832
主题中讨论的其他器件:LMK04828LMK04821

在 LMK04832上、所有奇数时钟都像上一代 LMK04828一样配置为 sysref 时钟输出、但新的 LMK04832输出的振幅要低得多、并且噪声比器件时钟大得多。 将时钟输出更改为器件时钟会使我们的振幅恢复到信号质量、但这对我们来说不是一个选项、因为我们需要特定的时钟来使用 sysref 分频器。 这种差异非常糟糕、以至于这些时钟根本无法使用。 在该系列的先前版本(LMK04821、LMK04828)上、这不是 SYSCREF 时钟的问题。

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    您好 Oliver、

    您使用的输出类型是什么、您在输出上看到的振幅是多少? 您的频率是否有任何变化?

    谢谢、

    Vibhu

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    我们尝试过仅具有大约550mVpp 振幅差分的 LVDS。 在另一个输出上、我们尝试了 LVPECL、它仅提供大约600mVpp 的差分振幅。 我们使用10MHz 作为输出频率、结果就是这些低振幅。 通过将这些输出更改为器件时钟、我们可以看到全幅值、但一旦我们返回到 sysref 时钟、幅值就会很低。 器件时钟或 sysref 时钟的频率和输出类型相同。 我们的器件时钟输出幅值对于 LVDS 为800mVpp、对于 LVPECL 为1.6Vpp。 我们注意到的另一点是、当配置为 sysref 时钟时、输出的正负极引脚之间不对称、因此正极侧可能为400mV、负极侧可能为200mV。 在器件时钟上、LVPECL 的正负电压均为800mV、LVDS 的正负电压均为400mV、这是完全对称的。

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    您好 Oliver、

    一些后续问题:

    当使用较低或较高的分压器时、您看到电压摆幅有何改善?

    10MHz 输出是否处于正确的频率?

    您的 Vcc3_SYSREF 电源看起来正常吗?

    谢谢、

    Vibhu

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    我们的基准输入为10MHz 至 CLKin0 (引脚37和38)。 输出始终是正确的频率。 我们的电源对所有引脚都很好。 我不知道您所指的分压器在哪里。 这是芯片中的一个选项、还是您希望实际在板上使用?

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    您好 Oliver、

    抱歉、我讲错了、我指的是 SYSREF 时钟分频器。

    谢谢、

    Vibhu

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    输出振幅和噪声不会根据 SYSREF 时钟分频器发生变化。

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    您好 Oliver、

    您是否使用了 EVM、其输出端的默认端接? 如果没有、请向我提供有关输出端接的信息。 此外、如果您可以提供寄存器转储、我可以在 TICSPro 上检查是否设置正确。

    谢谢、

    Vibhu

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    这是操作符错误。 我刚刚发现、我不小心将 SYSREF_MUX (寄存器0x139)设置为 SYSREF 脉冲发生器模式。 将其更改为 SYSREF 连续后、我的问题就迎刃而解。