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[参考译文] CDCM7005:PDN 衰减 Fmax。

Guru**** 2390755 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/877550/cdcm7005-pdn-decap-fmax

器件型号:CDCM7005

如何在 PDN 衰减分析中计算目标阻抗的最大频率。

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    您好、Naveen、

    PDN 引脚上的电容器的主要用途是缩短斜升时间、因为 PDN 引脚的斜升速率不应快于 VCC 或 AVCC (在引脚说明部分中介绍)。 分流电容器和内部150kOhm 上拉电阻器构成一个低通滤波器。 该引脚的斜坡时间取决于带宽或 RC 时间常数。

    例如,如果电容值为0.01uF,则时间常数为0.01e-6*150e3 = 1.5ms,这意味着 PDN 引脚在1.5ms 内斜升至其最终值的63%。

    此致、
    Hao

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    增加斜坡是衰减电容器的应用之一、它也用于补偿瞬态电流、这意味着由于负载波动、负载电流也会随电压的变化而变化、时间衰减将提供瞬态电流。

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    您好、Naveen、

    刚才意识到 PDN 意味着电力输送网络。 我认为您正在讨论 bar{PD}引脚。 遗憾的是、我不熟悉电力输送分析。 您能否更具体地了解分析所需的芯片规格? 我不确定 目标阻抗的最大频率是什么意思。

    此致、
    Hao