[参考译文] LMX2594EVM：时钟与放大器；计时论坛

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/965041/lmx2594evm-clock-timing-forum

器件型号：LMX2594EVM
主题中讨论的其他器件：LMX2594

我正在使用 TICSPRO 处理以3.2GHz 运行、基准频率为10MHz 的应用。根据自动生成的输出(CHDIV 等)、如果我正确遵循流程图、LMX2594将在同步类别1中运行。我的理解是、在这种情况下、我必须启用 VCO_PHASE_SYNC、但我不需要提供 SYNC 脉冲来在加电时断言确定性相位。您能确认这是正确的吗？

我提出这一问题的主要原因是、我的测试结果未在加电过程中表现出确定性相位关系、我想知道我是否配置了错误的内容、或者我是否以某种方式误解了流程图。

我的测试台包括同时对两个3.2GHz 信号进行采样。第一个信号是 EVM 的输出(我从中寻找启动时确定性相位的信号)。第二个信号由3.2频率合成器生成、该合成器为 EVM 提供参考、如果在采样持续期间保持连续运行、而不会以任何方式干扰其输出、则该合成器将生成该信号。采样时、我监控这两个信号之间的基带相位差、这两个信号在数分钟内在优于1度的水平下非常稳定。在捕获过程中、我随机关闭 EVM 电源、将其恢复、并使用 TICSPRO 对其进行重新编程、然后查看 EVM 关断时相位差是否继续存在。在某些情况下、EVM 会在其关闭的阶段启动、但更常见的情况是、在断电事件之前和之后的相位差存在显著差异。

您能不能提供任何有关我为什么在整个功率周期中观察非确定性相位的见解？

Chris

5 年多前

0 admin 5 年多前

TI__Guru**** 2587345 points

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尊敬的 Chris：

您的理解是正确的：只要 VCO_PHASE_SYNC=1、在这种情况下就不需要同步脉冲。

您观察到的相位差是多少？它是一组一致的值、还是看似随机的偏移？我想到了两种可能性：

所包含的除法(CHDIV 和 NDIV 之间的公共除法)未正确同步、因此在常规间隔(90°、180°、270°)下可能存在一些相位偏移
将器件断电并重新上电会导致某种温度漂移、从而导致传播延迟变化(在这种情况下、应在再次实现热平衡后恢复信号的相位)

此致、

0 admin 5 年多前

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尊敬的 Derek：

感谢您的回答。我坚信、我看到的是相位的一些热平衡、但这似乎很快就实现了热平衡。在断电后恢复相位的情况下、我可以看到在恢复电源后的5-10秒内、相位会稳定到特定值。我相信我看到的是90度的偏移倍数、现在您已经提到了它。您能告诉我如何在两个分频器之间建立同步呢？除了 VCO_PHASE_SYNC 之外、我没有看到任何其他控制位来控制同步状态、但可能还有其他我要忽略的内容吗？数据表似乎非常简单地描述了类别1的同步要求。

Chris

0 admin 5 年多前

TI__Guru**** 2587345 points

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尊敬的 Chris：

如果在器件锁定后每秒再次写入 VCO_PHASE_SYNC=1、结果是否看起来更加一致？写入 VCO_PHASE_SYNC=1等效于生成同步脉冲、因此在 PLL 完全锁定之前进行同步可能会导致一些同步问题。

只需检查：是否启用了混泥种子？是否有已编程到 MASK_SEED 的值？这些不应是必需的、但可能是潜在的发现。

此致、

0 admin 5 年多前

TI__Guru**** 2587345 points

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尊敬的 Derek：

编程期间启用了混频种子、但手动重新发出同步脉冲和切换 FCAL_EN 的组合似乎会逐渐形成系统启动阶段；感谢这一建议。在下电上电、重新编程和同步之后、会立即出现一个相对较长(~10-20秒)的周期、在此期间相位稳定至其稳定状态值、大概这是由组件热化引起的。以下稳定状态阶段通常不是关断前输出信号的阶段。我的实验表明、组件必须在发出 SYNC 之前实现热阻。只有这样、我才会在整个电源循环事件期间观察相位的连续性。您是否知道这种行为是预期行为、还是应在启动后(由于组件正在进行热化)立即发出同步、从而产生相同的相位关系？我怀疑答案是、您必须或应该等到组件经过热处理、但我想知道 TI 的建议是什么。

再次感谢、

Chris

0 admin 5 年多前

TI__Guru**** 2587345 points

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尊敬的 Chris：

您的结果是我所特有的、因为如果我将数据表视为已编写数据表、那么无论组件是否处于热平衡状态、从锁定时刻起、同步都应该是确定性的。在配置中(10MHz OSCin、3.2GHz Fout)、N 分频器中包含4分频、当 VCO_PHASE_SYNC_EN=1时、环路中的通道分频器部分(即所有部分)应在每次锁定后确定性同步。

我唯一的进一步测试建议是：尝试使用 MASK_SEED_EN=0的同步过程。数据表7.3.11中有一个部分描述了当 MASK_SEED_EN=1和 VCO_PHASE_SYNC_EN=1时的"附加限制"、因此这可能就是这样的情况之一。

您似乎能够按照您详述的过程在功率周期之间实现确定性同步、因此我建议您等待热平衡、因为它似乎可以满足您的需求。对于我们而言、我们将检查是否需要为此用例修改同步流程图中的说明。

此致、

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