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[参考译文] CDCLVC1106:在负载侧使用50 Ω 终端驱动同轴电缆需要更大的振幅。 可以并行输出来实现这一点吗?

Guru**** 2377000 points
Other Parts Discussed in Thread: CDCLVC1106
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/931881/cdclvc1106-driving-a-co-ax-with-a-50-ohm-termination-on-load-side-need-more-amplitude-is-it-ok-to-parallel-outputs-to-achieve-this

器件型号:CDCLVC1106

你(们)好

  我在需要将精密10MHz 方波时钟分配给多个实验室设备的应用中使用 CDCLVC1106。 在大多数设备上、接收端接50欧姆(按照良好的传输线路做法)、而这50欧姆端接不可拆卸。  当我使用 CDCL1106发送该信号时、它的驱动电流不足、无法提供所需的3.3伏摆幅来触发某些实验室设备的逻辑。 我发现、如果我将'1106的两个通道的输出连接在一起、 (每个通道都有一个10欧姆的缓冲电阻器)、我将获得足够的驱动来运行实验室设备。 我的问题是、这是可以做的吗?  我个人认为并联两个输出通道与使每个通道驱动自己的负载没有区别、但我向专家提问。 这是否会影响  引脚对引脚的偏斜? 这会影响抖动吗?  更好的问题可能是、对于通过端接50欧姆的传输线路来驱动 CMOS 电平、您建议使用什么部件(如果有)?

 谢谢、

  -- Lou

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    您好、Lou、

    请在周末后进行更新。 感谢您的发帖。

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    您好、Lou、

           我很乐意为您提供有关此问题的帮助。 正如您必须注意的那样,当您用50欧姆电阻终止 CMOS 缓冲器时,输出只会摆动到0.5*VDD;这是预期的行为,因为这基本上是一个使用50欧姆内部终端和50欧姆外部终端形成的分压器。 通常不建议使用50欧姆的电阻端接 CMOS 型驱动器,因为此类直流终端可能无法处理大电流(VDD/100欧姆=33mA,3.3V)。  

    但是、对于您的应用、如果我正确理解您的解决方案、您将尝试执行下图所示的操作:

    这在获得所需的驱动强度方面应该很好,请注意,在上图中,输出摆幅将主要是 VDD*(50/(50+50||||50)),其中50||||50是并联电阻,因为它连接了两个并联的输出通道。  

    请注意、这样做会影响组合输出的交流性能。 其原因是任何输出通道之间存在有限的偏斜、最大值可达 D/S 中指定的50ps 因此、连接两个输出将影响抖动、上升/下降时间等  

    您可以通过两种方法解决此问题:

    1) 1)交流耦合输出(在本例中只需要一个通道)、并将直流偏置到正确的共模

    2)使用输出电阻非常低(输出驱动更高)的器件

    如果您需要进一步澄清、请告诉我。

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    是的、以上就是我为获得所需的输出驱动电流而执行的操作。 有点黑客攻击、

    但它起作用。  

    您说:  

    "2)使用输出电阻非常低(更高输出驱动)的器件"

    您能否建议输出电阻非常低的器件? 有没有  

    由 TI 制造的线路驱动器、您会推荐它吗?

     谢谢、

       -- Lou

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    您好、Lou、

          它肯定会起作用、但正如我提到过的、性能将受到影响、尤其是抖动。  

    我能够进行快速搜索、找到了一款可能有希望的器件:https://www.ti.com/lit/ds/symlink/sn74lvt125.pdf?ts=1597731648386&ref_url=https%253A%252F%252Fwww.ti.com%252Flogic-circuit%252Fbuffer-driver%252Fnon-inverting-buffer-driver%252Fproducts.html

    请注意、我不太熟悉逻辑器件系列、建议与他们的应用团队的某个人联系以进行澄清。 需要指出的另一点是、逻辑器件系列不一定针对抖动进行了优化、并且它们在数据表中未指定抖动。 如果您的应用对抖动和相位噪声至关重要、我们可以建议使用交流耦合电容器和偏置电阻器的替代解决方案。