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[参考译文] LMK04131:参考时钟

Guru**** 2386610 points
Other Parts Discussed in Thread: LMK04131, LMK04133
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/761474/lmk04131-reference-clock

器件型号:LMK04131
主题中讨论的其他器件: LMK04133

你(们)好

我对 lmk04131的时钟输入有疑问。

我不知道如何选择连接到 OSCin 的 VCXO 和连接到基准时钟 CLKin0/1的 VCO 的值

我需要160MHz 和320MHz 输出。 我想知道如何确定输入频率。  

此致 Michelle

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    您好!

    LMK04131是一款抖动清除器。 这通常与恢复时钟的现有输入一起使用、但如果您的基准频率较低或与输出频率无关、从而导致低相位检测器频率、也可以使用。 低相位检测器频率可能会导致未优化的 PLL 噪声。

    如果您只需要160MHz 和320MHz 输出、则可以绕过 LMK04131等双环路器件的第一个 PLL、或使用不具有双环路功能的器件。 您应该选择的频率是将频率精细划分为160和320 MHz 的频率。 因此、20、40或80MHz 等频率可能是输入频率的理想选择。

    请参阅此演示、了解如何选择 PLL 环路带宽。 它还进一步说明了 PLL 不同相位检测器频率的影响、该频率可能由不同的基准频率强制。
    e2e.ti.com/.../664163

    另请参阅 http://ti.com/clockarchitect
    此工具允许您键入所需的输入/输出频率。 进入工具后、会出现一个复选框、用于自动推荐输入频率。

    73、
    Timothy
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    你(们)好

    pdf 很好、非常感谢。

    只是一句话;lmk04131是根据我的应用在另一篇文章中推荐的。 我不知道如何设置它。

    我的问题是、我通过低引脚数 FMC 从 FPGA 运行 DAC 和 ADC、因此可用的时钟引脚非常有限。 我有3个差分对、但我的设计仅使用2个差分对会有好处。 我需要1来同步从 ADC 返回的数据、需要1来同步从 lmk04131返回到 DAC 的数据。

    如前所述、我有第三个时钟用作 lmk04131的参考时钟、但我真的想使用该 FMC 引脚进行数据传输。

    如果我像您提到的那样绕过第一个 PLL、这意味着我不需要参考时钟、而只需要第二个 PLL 的外部 VCXO、或者无论怎样、我是否需要参考时钟?

    我试过时钟架构仿真、很显然我不能使用 lmk04131、但使用 lmk04133它可以。 它建议内部 VCO 达到1920MHz、基准输入为19.2MHz。 但是、这不会被160和320 MHz 信号分为偶数。 它不会对外部 VCXO 的值作任何评价。

    我不理解你的第一句话。 如果基准信号直接来自 FPGA、我是否只需要抖动清除器器件? 如果我查看 lmk04133的数据表、系统图如下所示

    在这里、参考时钟是从 VCO 生成的。 这是应该被分成一个很好的偶数的那个吗?

    此致 Michelle

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    我假设 FPGA 位于 FMC 的一侧、我们称之为 FPGA 板。
    DAC、ADC 和 LMK041xx 位于 FMC 的另一侧、我们称之为 AFE 板。
    首先、我们应确定需要多少个时钟域。
    如果 FPGA 可以具有用于 ADC 和 DAC 数据处理的单独时钟域、那么 LMK041xx 提供的时钟就足够了。
    AFE 板可将本地 XO 用作 LMK041xx 的基准。 XO 位于 LMK041xx OSCin 上。 LMK041xx 仅在 PLL2模式下运行。
    XO 频率可以是20MHz、40MHz、80MHz。 25MHz XO 会比以前的选项更差。

    如果 FPGA 必须在一个时钟域中运行、则意味着 FPGA 中的所有操作都是同步的、那么 LMK041xx 应从 FPGA 获取参考。
    LMK041xx 必须在双 PLL 抖动清除器模式下运行。 那么、我们需要在 OSCin 引脚上使用 VCXO。