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[参考译文] LMK03318：输入抖动 RMS 规格对输出抖动 RSM 规格的影响

admin
Guru**** 2756835 points

Other Parts Discussed in Thread: LMK03318

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/794027/lmk03318-effect-of-input-jitter-rms-spec-on-output-jitter-rsm-spec

器件型号：LMK03318

你好。

我们使用 webench 仿真来识别 LMK03318的抖动 RMS 规格。

我客户的输入方法是 LVPECL、输出方法是 CML。

当相位噪声范围设置为12kHz 至20MHz 并且处于客户的规格范围内时、输出抖动 RMS 计算为1181fs。

此时、我认为输入 LVPECL 的抖动值最高可达510 fs。 这是否会影响输出抖动 RMS 值？

我的客户希望输出抖动 RMS 值在150fs 以内。

请检查一下。

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    TI__Guru**** 2756835 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好、Anthony、

    您可以将输入时钟的相位噪声提供给 Webench、然后您将获得更真实的仿真结果。
    在您的 webench 设计中、单击"Enter Custom Phase Noise for Reference or VCO/VCXO"
    按照弹出指令完成输入基准时钟的相位噪声。
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    TI__Guru**** 2756835 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    感谢你的答复。

    但我的客户只希望看到以下内容：

    即使输入抖动约为510fs、输出抖动是否仍低于150fs？

    我们没有额外的 webench 仿真所需的相位噪声信息。如果输入是时域抖动 RMS 约为510fs (femto second)时的噪声、那么通过 lmk03318的输出是否会将其衰减至约150fs？  我只是想知道这个。

    请检查一下。

    谢谢你

    此致。

    Anthony 先生

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    TI__Guru**** 2756835 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好、Anthony、

    答案不是那么简单。
    根据相位噪声、我们可以计算抖动。 但是、由于抖动、我们无法重建相位噪声分布。
    对于给定的抖动、存在许多可能的相位噪声分布。 例如、对于特定时钟、近端相位噪声较差、但远端噪声很好。 积分抖动可能与另一个时钟相同、相反、近端和远端相位噪声是公平的。 如果您使用这些时钟作为 PLL 的基准、则输出相位噪声(和抖动)会有所不同。
    如果不知道输入时钟的相位噪声分布、就无法判断输出时钟的外观。

    LMK03318是一款时钟发生器、具有非常好的相位噪声参考时钟、可生成噪声极低的输出时钟。
    虽然我们可以将其用作抖动清除器、但我们必须知道参考时钟的相位噪声、以确定其抖动消除能力。

    为了安全起见、我们可以使用 LMK048xx 等双环路抖动清除器。 这些器件的第一个环路用于执行抖动消除。 借助外部 VCXO、抖动消除能力非常强。 我非常确信、这些器件可以将500fs 的输入时钟清理为150fs 的输出时钟。
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    TI__Guru**** 2756835 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    你(们)好

    感谢你的答复

    我共享您请求的输入时钟的相位噪声数据。

    在仿真中将相位噪声值放入 VCO 值是否正确？

    请检查一下。

    谢谢你

    此致

    Anthony 先生

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    TI__Guru**** 2756835 points
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    您好、Anthony、

    一个示例。

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    TI__Guru**** 2756835 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    你好 ，Noel！  

    感谢您的盛情款待。
    还有一个问题。 何时使用 VCO 函数？
    对于我的客户提到的抖动噪声、这不是基准时钟的噪声、而是输入时钟的抖动噪声、如下所示。
    如您所说、通过设置"REF"来模拟这种情况是否正确？是否无需通过设置"VCO"进行仿真？
    请检查它。

    谢谢你。

    此致。

    Anthony 先生

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    TI__Guru**** 2756835 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好、Anthony、

    您正在使用 LMK 器件的内部 VCO、webench 已经具有 VCO 特性、因此您无需告诉 webench。
    您得到的相位噪声图描述了输入时钟(参考时钟)的特性、您需要向 webench 介绍这一点、以便获得更准确的仿真。

    建议您花几分钟时间阅读我的博客、以更新一些 PLL 相位噪声基础知识。
    e2e.ti.com/.../timing-is-everything-understanding-pll-loop-filter-response