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[参考译文] LMK05028：输入到输出相位偏移

admin
Guru**** 2526700 points
Other Parts Discussed in Thread: LMK05028

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/820925/lmk05028-input-to-output-phase-offset

器件型号：LMK05028

您好！

我对 LMK05028有疑问。

[问题]

LMK05028的输入到输出相位偏移的最小/最大值是多少？
我想知道输入到输出相位偏移导致的器件之间的输出相位差。

此致、

Kaede Kudo

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    TI__Guru**** 2526700 points
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    Kudo-San、您好！

    明天早上我会得到你的答复，很抱歉耽误你的时间。

    此致、

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    TI__Guru**** 2526700 points
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    Kudo-San、您好！

    器件上的变化约为+/- 0.2ns。  会更高一些。

    73、
    Timothy

  • 0
    TI__Guru**** 2526700 points
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    Timothime-San、您好！

    感谢您的合作！

    据了解、输入到输出相位偏移的变化可视为多个器件之间输出的相位差。

    此致、

    Kaede Kudo

  • 0
    TI__Guru**** 2526700 points
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    Timothime-San、您好！ 

    让我向您提出更多问题。
・相位偏移是否可通过 DPLL1_REF_SYNC_PH_OFFSET 进行调节？
・即使在电源再次打开后、上述寄存器设置的相位偏移也会保持不变？
・上述寄存器设置的分辨率是多少？ 

    此致、 
    Kaede Kudo
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    TI__Guru**** 2526700 points
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    你好

    我还有一些问题。
    请问您能帮我解决问题吗？

    我现在使用 LMK05028 EVM 来检查输入到输出偏移是否确定。
    但是，我尚未确认。
    在下面附加我的状态和配置文件。
    如何解决此问题？

    [问题]
    •输出和输入之间的相位关系不是去二联律延迟。
    • 我使用示波器观察了输出信号和输入信号的波形。
    • 我触发了输入信号。
    • 此时、输出信号的相位始终波动。

    [预期行为]
    •输入和输出之间的相位关系应是确定性延迟。

    [设置文件]

    [设置内容]
    • 输入= 166.67MHz
    • 输出= 166.67MHz
    •  2环路、REF、APLL
    •  ZDM =使能
    •  LMK05028 EVM RevA1

    [问题]
    “我的・有什么问题吗？
    ・零延迟模式的设置方法是否错误？
    ・是否有 DPLL TDC 设置？

    此致、

    Kaede Kudo

  • 0
    TI__Guru**** 2526700 points
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    我很抱歉
    我没有附加配置文件、因此我想将其附加到这里、但我无法插入 TCS 文件。
    如果您知道如何提取配置文件、请告诉我。

    此致、
    Kaede Kudo

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    TI__Guru**** 2526700 points
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    Kudo-San、您好！

    如果您将.TCS 文件重命名为.txt、则应该能够附加。

    我的理解是、E2E 团队将进行更新以允许附加.TCS 文件、但似乎尚未完成。

    73、
    Timothy

  • 0
    TI__Guru**** 2526700 points
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    Timothime-San、您好！

    感谢您的评论。

    我有一个文本文件。
    感谢您的确认。

    e2e.ti.com/.../190723_5F00_test_5F00_e2e.txt

    此致、

    Kaede Kudo

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    TI__Guru**** 2526700 points
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    您好！  

    上一个是导出寄存器数据的文本文件。
    我将再次发送将.TCS 更改为.txt 的文件。

    e2e.ti.com/.../190722_5F00_test_5F00_e2e_5F00_2.txt


    感谢您的确认。

    此致、

    Kaede Kudo

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    Kudo-San、您好！

    我假设您是在输入和 OUT4还是 OUT5之间进行测量？

    我目前没有在实验室中尝试您的文件、如果需要、我可以在下周进行。  但是我确实观察到...

    1) 1)只有通道45具有 SYNCEN = 1。  因此、相位到其他时钟输出不是确定性的。
    2) 2) 166.67来自 DPLL1和 DPLL2。  我希望所有166.67MHz 时钟都来自单个 DPLL、这样您就可以设置 PLL1_PRI_CH03_SYNC_BNK 和 PLL1_PRI_CH47_SYNC_BNK、并将它们一起同步。

    73、
    Timothy

  • 0
    TI__Guru**** 2526700 points
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    Timothime-San、您好！

    感谢您的评论。

    我理解您的说法。

    但是、我目前担心的是、输入和输出之间的相位差不是确定性的。

    我更正了您指出的点、并再次使用示波器观察了输入和输出波形。

    /cfs-file/__key/communityserver-discussions-components-files/48/2262.190729_5F00_test_5F00_e2e.txt

    但是、输出的相位会相对于输入的相位发生波动。
    －黄色输入
    -蓝色 OUT4_P
    -粉红色 OUT3_P

    e2e.ti.com/.../190729_5F00_test_5F00_e2e-_2800_2_2900_.MOV

    我曾期望输入到输出相位偏移 始终是确定性的、在 ZDM 中使用它、我的识别是否错误？

    或者设置是否有奇怪的东西？

    感谢您的确认。

    此致、

    Kaede Kudo

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    Kudo-San、您好！

    我已确认您的文件。  我能够测量输入和输出之间的确定性相位。  此测量是从 IN0_P 到 OUT4_P 进行的

    • 在您的配置中、只有 OUT4_P 具有确定性相位、因为它是启用同步的唯一输出(通过 CH45_SYNCEN = 1)。
    • 请注意、OUT4也由 DPLL1驱动。  我注意到 DPLL2配置了10Hz 环路带宽和具有更高 TDC 速率的无线/BTS、由于环路带宽与 TDC 速率的设置以及比率、LOPF 变为低电平所需的时间可能会更长。
    • 我还确认、通过在 TPH 偏移(ns)中输入值、它将在从输入到输出的相位中产生偏移。

    我建议进行以下更新：

    如果您在将确定性输入的测量值重复到输出阶段时遇到困难、请读取状态位并确认...

    • 基准电压经验证、REF0VALSTAT = 1或 REF1VALSTAT = 1。
    • 频率和相位锁定位的损耗很低。  DPLL？_LOFL = 0且 DPLL？_LOPL = 0
    • 根据初始状态、编程后(Ctrl + L)、您可以通过单击顶部工具栏中的按钮尝试执行软复位芯片。

    73、
    Timothy

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    Timothime-San、您好！

    感谢您的合作！

    我已尝试您的设置。
    但是、输入到输出相位偏移还不是确定性的。
    以下内容得到确认和执行，但没有用处。

    • 基准电压经验证、REF0VALSTAT = 1或 REF1VALSTAT = 1。
      ⇒我使用 input0。 REF0VALSTAT=1
    • 频率和相位锁定位的损耗很低。  DPLL？_LOFL = 0且 DPLL？_LOPL = 0
      ⇒DPLL1_LOFL=0、DPLL1_LOPL=0
    • 根据初始状态、编程后(Ctrl + L)、您可以通过单击顶部工具栏中的按钮尝试执行软复位芯片。
      ⇒I DID、但输出相位差不是确定性的、并且会波动。

    很抱歉、但请继续联系我们。

    *您能告诉我们您评估的环境吗？
    示例)基准输入使用的是什么？

    我将尝试与您的评估环境尽可能相似、并查看我们是否能够获得类似的结果。

    此致、
    Kaede Kudo

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    Kudo-San、您好！

    这是我的设置中的一个示例图。  我重复此测量5次、它们看起来都是一样的。

    CH1 (黄色)=信号发生器的 IN0_P 信号。  我认为这是 Rohde & Schwarz SMB100A。
    CH2 (绿色)= OUT1_P
    通道4 (粉色)= OUT4_P

    *如果你看看两个输出、就像我在上面所做的那样。 您能否确认它们之间具有相同/确定性相位？

    *请确认所有波形都正确显示，它们只是从一个锁到下一个锁的变化。
      您能像上面一样共享信号图吗？  第二个示例说明了它们是如何移位的？

    73、
    Timothy

  • 0
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    Timothime-San、您好！

    感谢您的联系。

    我能够解决这个问题、并且能够看到输入和输出中的确定性延迟。

    原因是我使用的参考有漂移。
    我通过采取以下两项措施之一来解决这个问题。
    *将基准更改为信号发生器输出。
    *扩展 DPLL1的 LBW。

    感谢您的合作！

    此致、

    Kaede Kudo