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[参考译文] LMK04816BEVAL:更改 VCXO 后产生125 MHz 的问题

Guru**** 2378650 points
Other Parts Discussed in Thread: CODELOADER
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/820638/lmk04816beval-problem-deriving-125-mhz-after-changing-vcxo

器件型号:LMK04816BEVAL
主题中讨论的其他器件:CODELOADER

我正在尝试 使用 TICS Pro 配置 LMK04816B 评估板器件。  我正在尝试在器件上生成125和6.256MHz 时钟。 我已将122.88MHz VCXO (U2)换成100MHz 版本、并将以100MHz (0.0dBm)驱动 CLKIn1。   

我在 TICS Pro 和评估板中执行了以下操作:
-加载默认的122.88MHz ClkIn1、122.88MHz VCXO
-将 PLL1和 PLL2页面上的参考值更改为100MHz
-关闭 EN_SYNC
-修改 LD 和 HOLD 状态引脚以收集以下结果:

PLL1_R/2 = 416.7kHz
PLL1_N/2 = 416.7kHz
PLL1 LD 被锁定

PLL2_R/2 =~50MHz
PLL2_N/2 = 56MHz
PLL2 LD =未锁定

(我注意到 PLL2 VCO 输出为2GHz、而 TICS 指示的输出超出了 PLL 的范围。  我将 N 分频器更改为12以将 VCO 置于2400MHz)
PLL2_R/2 ~50MHz
PLL2_N/2 47MHz
PLL2 LD 未锁定

要将 PLL2锁定在产生125MHz 和6.25MHz 的频率、我需要做什么?  除了交换 VCXO 之外、我还需要进行其他修改吗?

谢谢、

道格

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    FWiw: VCXO 的输出看起来是干净的100MHz。

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    您好 Doug、

    您能否检查 VTUNE2测试点的电压? 听起来 VCO 被强制进入电源轨。 可能 VCO 极性发生翻转、或者环路滤波器中的某个位置有一个线断。

    您是否使用了任何0延迟设置? 0延迟可能会导致 TICS Pro 误报告实际 VCO 频率、 有关更多信息、请参阅用户指南的"在 CodeLoader 中对0延迟模式进行编程"部分。

    此致、

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    我使用默认的双 PLL 功能。   我尝试尽可能少地对器件的默认设置进行更改。  

    我在 Vtune2测试点上测得的电压为3.26V、看起来确实是在电源轨上。  

    除了交换 VCXO 之外、我看不到以前在122.88MHz 下工作的电路板的任何其他更改。

    道格

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    通过使用猴子重现莎士比亚的故障排除方法、我将 PLL2相位检测器频率从100MHz 降低到50MHz (以及 N 分频器的适当加倍)、并且我的 VTune2 TP 稳定且 PLL2锁定。  

    我不确定做这件事会产生什么影响、但器件现在似乎可以根据需要工作。  

    为什么将相位检测器频率减半会使 PLL2保持稳定?