[参考译文] LMK04826BEVM：LMK04826未锁定

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https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/788004/lmk04826bevm-lmk04826-not-locking

器件型号：LMK04826BEVM
主题中讨论的其他器件：LMK04826

您好！

首先、我已将 VCXO 替换为120MHz、其中一个使用 122.88MHz 安装版本的 Crystek CVHD-950 VCXO、它在192MHz 输出下显示~130fsec、效果非常好。现在、我再次将 VCXO 替换为尺寸为5x3.2mm (小尺寸)的 Transko TV53A VCXO、以小尺寸检查我的实际应用、但不知为何它根本不会锁定。对于所有120MHz 配置、我使用了相同的 TicPro 设置文件、但一个供应商工作、另一个供应商没有工作。您能检查一下发生了什么情况吗？我最终将使用 Transko 的 TSMV5 5x3.2mm VCXO、但设计和交付需要时间。因此、我临时尝试使用 TV53A。我发现 TV53A 的输入阻抗非常高1Mohm、而 CVHD-950的输入阻抗为51k Ω。我想知道这是否重要。

总结：

OSCin：将 EVB 上的122.88MHz VCXO 替换为120MHz VCXO (Krystek CVHD-950)。工作得非常好。

2. OSCin：将 Kastek 120MHz VCXO 替换为 Transko TV53A (5x.32mm 尺寸)。无锁定

3. OSCin：最终将在交付后使用 Transko TSMV5 (5x.32mm 脚本)。

3. CLKin1：Firefly-II OCXO 始终用于10MHz 频率。

请告诉我有什么建议可以尝试。我已附上上述所有器件的产品说明书的 PDF 文件。

谢谢

e2e.ti.com/.../FF_2D00_IIA_5F00_low_2D00_g_5F00_DOCXO_5F00_specs.pdfe2e.ti.com/.../tv53a.pdfe2e.ti.com/.../tsmv5.pdf

5 年多前

0 admin 5 年多前

TI__Guru**** 1807890 points

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您好、Youngho、

您询问了输入输入阻抗。没有问题。越高越好。有趣的是、在过去我测量了 CVHD-950、发现它比51千欧更接近1兆欧。

当您说它根本没有锁定时，您能不能建议它是 PLL1、PLL2还是两者都没有锁定？

您是否确认了 TV53A 的输出时钟？它的标称频率是否为您期望的频率？

请注意、TV53A 指出它可用于 CMOS、LVDS 和 LVPECL 输出格式。您是否将 CMOS 版本用作 CVHD-950？如果您使用的是 LVPECL 版本、则需要提供一些发射极电阻器来获得输出时钟。 OSCin 时钟的总体故障将导致 PLL1和 PLL2被解锁。

您还进行了哪些其他调试？如果您将状态输出引脚设置为 PLL1 N/2、PLL1 R/2、您可以看到 PLL 正在获得什么... 如果它们具有固定相位、则它们处于锁定状态。您也可以对 PLL2 N/2和 PLL2 R/2执行此操作。对于这两种情况、您应该看到一半的相位检测器频率。

73、
Timothy

0 admin 5 年多前

TI__Guru**** 1807890 points

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您好、Timothy、

PLL1和 PLL2都未根据电路板上的锁定 LED 进行锁定。

我已经通过 OSCout 端口监视 TV53A 输出、发现频率约为120.0005MHz、并在10分钟内开始缓慢下降、接近119.9995MHz 供应商说 TV53A 的输出电流约为8mA。我忘记说、我还将 R4和 R61电阻值更改为210欧姆、将~8mA 的电阻值拆分为一半、而不是三分之一。此外、我还探测了 TV53A 的输出引脚、在 TC53A 输出引脚和 C4 (33pF)之间找到了~2.9Vpp、在 C4 (33pF)和 R4 (210 Ω)之间找到了~2.6V、在 R4 (210 Ω)和 R61 (210 Ω)之间找到了0.75Vpp。奇怪的是、在示波器 I 测量的是~0.75Vpp、而不是2.6V 的一半。我相信、这仍然是 LMK04826 OSCin 的良好输入范围。我还在 TV35A 上探测了 VTune 引脚、结果为~1.651V。

我在 DCLKout10端口上使用 LVDS 的输出类型。 CVHD-950的设置很好、并且与 TV53A 使用相同的设置。

在 DCLKout10端口上、我获得的输出频率为~193.1MHz、而不是192MHz。

我是否需要在该分压器网络中提供更多电流？请告知下一步操作。

谢谢

0 admin 5 年多前

TI__Guru**** 1807890 points

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您好、Youngho、

我预计低于预期 Vpp 的原因是射频不匹配。通过将 R61改变为51欧姆、您不再具有50欧姆的终端、反射将导致意外电压。

以确认输入信号。请将输出状态引脚编程到 PLL1 N/2和 PLL2 R/2、以查看 OSCin 信号的分频输出。您应该会看到一半的相位检测器频率。

我还建议对 PLL1 R/2和 PLL1 N/2进行编程并比较波形。理想情况下、它们应锁相。但是、如果没有、这可以提示您正在进行的操作/哪个信号不工作。 PLL2 R/2和 PLL2 N/2也是如此。请检查这些输出并提供建议。

73、
Timothy

0 admin 5 年多前

TI__Guru**** 1807890 points

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您好、Timothy、

我有 PDF 10MHz 用于 PLL1、120MHz 用于 PLL2。看起来我无法附加 TiCPro 设置文件、但下面是一个用于设置的屏幕截图。

关于 PLL1 R/2和 PLL1 N/2、我在 PLL1 N/2下测量了15MHz、在 PLL1 R/2下测量了5MHz。它们也不相同。

关于 PLL2 R/2和 PLL2 N/2、我在 PLL1 N/2下测量了65MHz、在 PLL1 R/2下测量了60MHz。它们的频率也不同。

我将使用50欧姆电阻器替换 R61和 R4、以获得正确的50欧姆阻抗、并查看这是否会产生差异。但是、如果您观察到要尝试的东西、请提供建议。

谢谢

0 admin 5 年多前

TI__Guru**** 1807890 points

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电阻器值已更改为计算出的所有50ohm。我认为由于不匹配而产生了反射。现在、PLL1 R/2和 PLL1 N/2测量到5MHz 的 PDF、应该是这样的。谢谢、

时钟和时序（参考译文帖）

时钟和时序（参考译文帖）(Read Only)

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