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[参考译文] LMK04208:LMK04208 uWire 输入信号逻辑电平

Guru**** 2387830 points
Other Parts Discussed in Thread: LMK04208
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/808351/lmk04208-lmk04208-uwire-input-signals-logic-level

器件型号:LMK04208

您好!

我有一个 Xilinx FPGA、通过电平转换器(1.8V 至3.3V)驱动 LEUWire、CLKUWire 和 DATAUWire。

将电平转换器输出直接连接到 LMK uWrire 输入时、信号似乎钳位到~1.8V、而不是达到3.3V。

在 uWire 信号上添加大型串联电阻器(>10K 欧姆)时、信号将按应有的方式达到3.3V。

在 LMK04208 EVB 文档中、我看到 TI 使用一个与 LMK 器件串联的15K 欧姆电阻器。

为什么需要大串联电阻器?

uWire 输入的类型是什么? (在数据表中、它表示它是 CMOS 输入)

此致、

Yossi

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    感谢您在 E2E 上发帖。 我已将您的职位分配给负责的工程师。 他很快就会回复你。

    此致、
    通道

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    您好 Yossi、

    uWire 输入结构内部没有钳位到1.8V 的电压。 有 ESD 二极管钳位到 IC 内部数字电路的电源轨、如果数字电路的电源引脚未通电、则钳位到~1.8V。 请检查 Vcc4 (引脚24)处的引脚电压、并确认它大约为3.3V。

    或者、可能会损坏 IC、从而影响数字电路。 此评估模块在 uWire 输入端包含15kΩ Ω 串联电阻器、以创建具有输入引脚电容的自然低通滤波器、这有助于防止过大的过冲或下冲损坏输入(尤其是在由长迹线和/或强驱动器驱动时)。 可能需要更换 IC、我建议将来保持 uWire 输入上的串联电阻。

    此致、