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[参考译文] LMK04808BEVAL：PLL2 0延迟

admin
Guru**** 1813740 points
Other Parts Discussed in Thread: LMK04808, CODELOADER
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/clock-timing-group/clock-and-timing/f/clock-timing-forum/848837/lmk04808beval-pll2-0-delay

器件型号：LMK04808BEVAL
主题中讨论的其他器件：LMK04808、 CODELOADER

根据数据表，LMK04808可配置为仅针对 PLL2运行“PLL2，内部 VCO，0延迟”。 我已经尝试在 LMK04808B 评估板上对此进行测试、但未成功。 OSCin 和 CLKout0可被锁相。 您或团队中的某个人能否帮助解决此问题？

 

我可以配置 LMK04808B 评估板以使“PLL2、内部 VCO”正常工作。 OSCin 和 CLKout0可以被锁相，但是如果 是，OSCin 和 CLKout0之间的相位不是一个固定值。

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    TI__Guru**** 1813740 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好，Jingjun，

    您是否曾尝试在 EVM 上使用0延迟的默认配置？

    另请参阅 EVM 文档部分、"在 CodeLoader 中对0延迟模式进行编程"

    >请注意、我建议您使用 TICS Pro 软件与 CodeLoader、它非常相似、但 GUI 不直接支持0延迟、因此使用起来很简单。  EVM 文档中的第二个部分将介绍一些详细信息。  您需要转至用户控制页面以启用反馈多路复用器并选择用于反馈的时钟。  如果反馈频率与 VCXO 频率相同、则所有频率都将正确计算。  否则、当正确编程0延迟时、VCO/输出频率将计算错误、但分频器将正确设置以提供请求的输出频率。

    如果仍有问题、您可以尝试将您的配置发布为保存的.TCS 文件。

    73、
    Timothy

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    TI__Guru**** 1813740 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    Timothy

    我已经使用 CodeLoader 和 TICS Pro 在 PLL2 0延迟配置之后测试了 LMK04808B 评估板：

    案例2：

    默认0延迟

    模式

    (CLKout8 =

    1474.56 MHz)

    两者  的工作方式相同。 对于  “PLL2、内部 VCO、0延迟”模式，我无法在 OSCout0和 Clkout0之间获得0延迟。

    但  对于 “PLL2、内部 VCO”模式，OSCout0和 Clkout0之间的延迟非常接近0。

    您能否帮助分析 我使用的以下*。TCS 文件中所示的设置。

    [设置]
    地址= 888
    时钟= 8
    数据= 4
    LE=2
    器件= LMK04808B
    iface=UWIRE
    ADDREST_I2C=0x0

    [引脚]
    PINNAME00=SYNC
    LOCATION00=7
    PINVALUE00=真
    PINNAME01=Status_CLKin0
    LOCATION01=3
    PINVALUE01=错误
    PINNAMEE02=Status_CLKin1
    LOCATION02=1
    PINVALUE02=错误
    PINNAME03=触发器
    LOCATION03=0
    PINVALUE03=错误

    [模式]
    NAME00=R0 (初始化)
    VALUE00=2148925824
    NAME01=R0
    VALUE01=1311488
    NAME02=R1
    VALUE02=2148794753
    NAME03=R2
    VALUE03=2148794754
    NAME04=R3
    VALUE04=1310787
    NAME05=R4
    VALUE05=1310788
    NAME06=R5
    VALUE06=2148794757
    NAME07=R6
    VALUE07=67633158
    NAME08=R7
    VALUE08=16842759
    NAME09=R8.
    VALUE09=67174408
    NAME10=R9
    VALUE10=1431655753
    NAME11=R10
    VALUE11=2554481034
    NAME12=R11
    VALUE12=1140920331
    NAME13=R12
    VALUE13=453771372
    NAME14=R13
    VALUE14=587366925
    NAME15=R14
    VALUE15=33554446
    name16=R15
    VALUE16=2147516431
    NAME17=R16
    VALUE17=3243574288
    NAME18=R24
    VALUE18=88
    NAME19=R25
    VALUE19=46777369
    NAME20=R26
    VALUE20=2410151962
    NAME21=R27
    VALUE21=268443163
    NAME22=R28
    VALUE22=1056284
    NAME23=R29
    VALUE23=25166237
    NAME24=R30
    VALUE24=33554846
    NAME25=R31
    VALUE25=2031647
    OSCIN00=122.88
    Extra PLL N DIV_1_00 = 0
    OSCIN01=122.88
    Extra PLL N DIV_1_01 = 0

    [灵活]
    CLKout0_1_Hs=0
    CLKout0_1_PD=0
    CLKout0_FREQ=122.88
    CLKout10_11_HS=0
    CLKout10_11_PD=1
    CLKout10_FREQ=1
    CLKout11_FREQ=1
    CLKout1_FREQ=122.88
    CLKout2_3_Hs=0
    CLKout2_3_PD=1
    CLKout2_FREQ=1
    CLKout3_FREQ=1
    CLKout4_5_Hs=0
    CLKout4_5_PD=1
    CLKout4_FREQ=1
    CLKout5_FREQ=1
    CLKout6_7_HS=0
    CLKout6_7_PD=0
    CLKout6_FREQ=1474.56
    CLKout7_FREQ=1474.56
    CLKout8_9_HS=0
    CLKout8_9_PD=0
    CLKout8_FREQ=1474.56
    CLKout9_FREQ=1474.56
    OSCout0_FREQ=122.88
    OSCout1_FREQ=1
    PLL2_PDF_FREQ=122.88
    PLL2_REF_FREQ=122.88
    VCO_FREQ=2949.12
    bSync=同步
    stStatus=PLL1 VCO 和 PLL2参考(OSCin)\n=122.88MHz

     

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    TI__Guru**** 1813740 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好，Jingjun，

    这里的问题是 CLKout8被用作反馈时钟。  该时钟为1474.2MHz。  之所以这样做是因为它仍然允许正确显示频率。

    如果您希望0延迟在122.88MHz 频率下工作、则必须将较低的频率反馈给 PLL2 N

    从 LMK04808数据表的"8.2功能方框图"部分的功能方框图中可以观察到、在0延迟模式下、FB 多路复用器直接馈入 PLL2 N2分频器。  因此、要使用您的配置在122.88MHz 输出频率下启用0延迟、

    1) 1)在"使用控制"页面上、将反馈_MUX 从 CLKout8更新为 CLKout0。  这将选择122.88MHz 的时钟输出以反馈到 PLL2 N

    2) 2)在 PLL2页面上、将 PLL2 N 值从12更改为1。  由于 CLKout0的122.88MHz 现在已传送到 PLL2 N 分频器、因此通过设置 PLL2 N = 1、相位检测器将从 CLKout0传输到122.88MHz。  现在、我们满足 PLL2相位检测器频率的两个公式。

    执行此操作后、由于 EVM GUI 不支持0延迟频率计算、因此 VCO 将错误地计算为122.88MHz * 1 (PLL2_N)* 2 (预 N 分频器)。

    它应使用方程式122.88MHz * 1 (PLL2_N)* 24 (CLKout0_DIV)。

    请使用您的配置尝试这两个更新。

    73、
    Timothy

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    TI__Guru**** 1813740 points
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    Timothy

    您的建议非常有用。  按照步骤"PLL2 0延迟"在 LMK04808B 评估板上工作。

    我有以下问题：如果评估 板上的 OSCin 为125MHz 30%占空比或正弦信号、而不是50%占空比时钟。    "PLL2 0延迟"可以工作吗？  我是否可以在评估板中测试这种情况？

     OSCin 输入有一个乘法 器 X2。  它是如何工作的？  这是否意味 着 OSCin 上的30%占空比或正弦输入将起作用？

    谢谢

    京军

     

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    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好！

    如果您的输入占空比为30%、则0延迟仍然有效。

    切勿将倍频器与非50%占空比输入一起使用、否则会产生不良的杂散。

    这适用于正弦波。

    要在 EVM 上进行测试、请使用示波器同时探测输入和输出、然后您应该在每次断电/上电和重新编程时看到确定性相位。

    73、
    Timothy

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    TI__Guru**** 1813740 points
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    Timothy

    为了避免占空比为30%的 OSCin 时钟的影响、我已将 PLL2" R Divider"设置为2。 在这种情况下、相位检测器将以61.44MHz 的频率工作。 我仍然希望 在输出端将 PLL2 0延迟保持在122.88MHz、我将 Pre-N Divider 设置为4而不是2。  为什么我无法使"PLL2 内部 VCO 0延迟"工作？ 此配置是否有任何技巧？

    谢谢

    京军

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    您好，Jingjun，

    在零延迟中、预 N 分频器被旁路。  由于相位检测器频率减半、因此需要将 N 分频器的值加倍以实现锁定。

    我最初没有提到详细 信息、在对 PLL2_N 寄存器进行编程后立即进行 VCO 校准期间、器件不会在0延迟模式下运行。  相反、VCO 将校准为 PDF * PLL2_P * PLL2_N_CAL 的频率、然后它切换到零延迟模式、该模式使用时钟输出分频器和 PLL2_N  因此、将 PLL2_P 值从2增加到4可以解决 VCO 频率适合校准的问题、也可以更改 GUI 的"User Control"选项卡中的 PLL2_N_CAL 值。  它在其他部分--> PLL2子组中。  屏幕右侧显示的内容。

    请参阅数据表的第9.1.5节"PLL 编程"。

    73、
    Timothy